參數(shù)資料
型號(hào)： MCF5249VF140
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160
封裝： 15 X 15 MM, MAPBGA-160
文件頁(yè)數(shù)： 108/454頁(yè)
文件大小： 6701K
代理商： MCF5249VF140
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13-12
MCF5249UM
MOTOROLA
FlashMedia Interface
13.4.2
FLASHMEDIA INTERFACE OPERATION
The FlashMedia interface is build around two Interface Shift Registers, each of which work independently.
The following figure shows a block diagram of one interface shift register.
Figure 13-9 One Interface Shift Register
The processor interface sends commands to the interface shift register. One command instructs the
interface shift register to do one of the following:
Transmit a packet of N bits to the FlashMedia device. The number of bits N is programmable. It is
also programmable if bits 15:0, or bits 47:0 in SD wide bus mode, need to be replaced with a valid
CRC or not. CRC insertion is possible for MemoryStick data packet and SecureDigital data packets.
CRC insertion is not possible for SecureDigital command packets.
Receive a packet of N bits from the FlashMedia device. The number of bits N is programmable. After
reception of all bits, the interface shift register will display on status line CRC_IS_0 if CRC check was
successful or not. CRC check is done for MemoryStick data packets and for SecureDigital data
packets. No CRC check is available for SD command packets.
Wait for an interrupt event from the FlashMedia device
After writing a command to the interface shift register, the processor needs to monitor TxBUFFEREMPTY
or RxBUFFERFULL, and read or write data to the interface as required.
When the transmit shift register is empty, new data is loaded from the TxBUFFERREG. If the transmit
buffer register is empty, the interface shift register will stop the SCLK_OUT clock, and wait for new
data to be written in the TxBUFFERREG.
When the receive shift register is full, data is transferred to the RxBUFFERREG. If the receive buffer
register is full, the interface shift register will stop the SCLK_OUT clock, and wait until the
RxBUFFERREG is read to empty.
If the number of bits in the packet to sent/receive from the FlashMedia is greater than 32, multiple
longword transfers to the buffer register are needed. All of these, except the first, contain 32 packet
bits. The last data word for the transfer always contains packet bits 31-0, even if CRC transmit or
check is on.
If e.g. a 48-bit transfer is requested to the FlashMedia, the first data word will contain 16 bits, the
second one will contain 32 bits. The first word is LSB aligned for receive data, MSB aligned for
transmit data.
Interface
Shift
Register
BS (MemoryStick mode only)
Serial data
CommandBits
bitCounter
shift_busy
int_level
crc_is_0
TxBufferEmpty
RcvBufferFull
loadTxShiftReg
storeRcvShiftReg
stopclock
(to clock generator)
SERIAL DATA
RxBufferFull
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料
PDF描述
MCF5251CDVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF5251CEVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF5251EVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF54417CMJ250 MICROPROCESSOR, PBGA256
MCF54418CMJ250 MICROPROCESSOR, PBGA256
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MCF5249VM140 功能描述:IC MPU 32B 140MHZ COLDF 160-BGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:MCF524x 標(biāo)準(zhǔn)包裝:1 系列:87C 核心處理器:MCS 51 芯體尺寸:8-位 速度:16MHz 連通性:SIO 外圍設(shè)備:- 輸入/輸出數(shù):32 程序存儲(chǔ)器容量:8KB（8K x 8） 程序存儲(chǔ)器類型:OTP EEPROM 大小:- RAM 容量:256 x 8 電壓 - 電源 (Vcc/Vdd):4 V ~ 6 V 數(shù)據(jù)轉(zhuǎn)換器:- 振蕩器型:外部 工作溫度:0°C ~ 70°C 封裝/外殼:44-DIP 包裝:管件 其它名稱:864285
MCF5251 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251_07 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor Data Sheet
MCF5251_08 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251CDVM140 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor
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