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參數(shù)資料
| 型號： | MC9S08SG32VTL |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, PDSO28 |
| 封裝： | ROHS COMPLIANT, TSSOP-28 |
| 文件頁數(shù)： | 85/328頁 |
| 文件大?。?/td> | 3232K |
| 代理商： | MC9S08SG32VTL |
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Chapter 11 Internal Clock Source (S08ICSV2)
MC9S08SG32 Data Sheet, Rev. 7
Freescale Semiconductor
175
11.3.2
ICS Control Register 2 (ICSC2)
76
5
4
3
2
1
0
R
BDIV
RANGE
HGO
LP
EREFS
ERCLKEN
EREFSTEN
W
Reset:
0
1
0
Figure 11-4. ICS Control Register 2 (ICSC2)
Table 11-3. ICS Control Register 2 Field Descriptions
Field
Description
7:6
BDIV
Bus Frequency Divider — Selects the amount to divide down the clock source selected by the CLKS bits. This
controls the bus frequency.
00
Encoding 0 — Divides selected clock by 1
01
Encoding 1 — Divides selected clock by 2 (reset default)
10
Encoding 2 — Divides selected clock by 4
11
Encoding 3 — Divides selected clock by 8
5
RANGE
Frequency Range Select — Selects the frequency range for the external oscillator.
1 High frequency range selected for the external oscillator
0 Low frequency range selected for the external oscillator
4
HGO
High Gain Oscillator Select — The HGO bit controls the external oscillator mode of operation.
1 Congure external oscillator for high gain operation
0 Congure external oscillator for low power operation
3
LP
Low Power Select — The LP bit controls whether the FLL is disabled in FLL bypassed modes.
1 FLL is disabled in bypass modes unless BDM is active
0 FLL is not disabled in bypass mode
2
EREFS
External Reference Select — The EREFS bit selects the source for the external reference clock.
1 Oscillator requested
0 External Clock Source requested
1
ERCLKEN
External Reference Enable — The ERCLKEN bit enables the external reference clock for use as ICSERCLK.
1 ICSERCLK active
0 ICSERCLK inactive
0
EREFSTEN
External Reference Stop Enable — The EREFSTEN bit controls whether or not the external reference clock
remains enabled when the ICS enters stop mode.
1 External reference clock stays enabled in stop if ERCLKEN is set or if ICS is in FEE, FBE, or FBELP mode
before entering stop
0 External reference clock is disabled in stop
相關PDF資料 |
PDF描述 |
|---|---|
| MC9S08SG32E1JTGR | MICROCONTROLLER, PDSO20 |
| MC9S08SG32E1WTL | MICROCONTROLLER, PDSO20 |
| MC9S08SG16E1CTLR | MICROCONTROLLER, PDSO28 |
| MC9S08SG16E1JTJ | MICROCONTROLLER, PDSO28 |
| MC9S08SG32E1MTGR | MICROCONTROLLER, PDSO20 |
相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC9S08SG4 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SG8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SG8_09 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SG8_12 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC9S08SG8 |
| MC9S08SG8CXXE | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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