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參數(shù)資料
| 型號(hào)： | MC9S08SG32VTL |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, PDSO28 |
| 封裝： | ROHS COMPLIANT, TSSOP-28 |
| 文件頁數(shù)： | 147/328頁 |
| 文件大?。?/td> | 3232K |
| 代理商： | MC9S08SG32VTL |
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Chapter 15 Serial Peripheral Interface (S08SPIV3)
MC9S08SG32 Data Sheet, Rev. 7
230
Freescale Semiconductor
NOTE
Ensure that the SPI should not be disabled (SPE=0) at the same time as a bit change to the CPHA bit. These
changes should be performed as separate operations or unexpected behavior may occur.
15.4.2
SPI Control Register 2 (SPIC2)
This read/write register is used to control optional features of the SPI system. Bits 7, 6, 5, and 2 are not
implemented and always read 0.
4
MSTR
Master/Slave Mode Select
0 SPI module congured as a slave SPI device
1 SPI module congured as a master SPI device
3
CPOL
Clock Polarity — This bit effectively places an inverter in series with the clock signal from a master SPI or to a
slave SPI device. Refer to Section 15.5.1, “SPI Clock Formats” for more details.
0 Active-high SPI clock (idles low)
1 Active-low SPI clock (idles high)
2
CPHA
Clock Phase — This bit selects one of two clock formats for different kinds of synchronous serial peripheral
devices. Refer to Section 15.5.1, “SPI Clock Formats” for more details.
0 First edge on SPSCK occurs at the middle of the rst cycle of an 8-cycle data transfer
1 First edge on SPSCK occurs at the start of the rst cycle of an 8-cycle data transfer
1
SSOE
Slave Select Output Enable — This bit is used in combination with the mode fault enable (MODFEN) bit in
SPCR2 and the master/slave (MSTR) control bit to determine the function of the SS pin as shown in Table 15-2.
0
LSBFE
LSB First (Shifter Direction)
0 SPI serial data transfers start with most signicant bit
1 SPI serial data transfers start with least signicant bit
Table 15-2. SS Pin Function
MODFEN
SSOE
Master Mode
Slave Mode
0
General-purpose I/O (not SPI)
Slave select input
0
1
General-purpose I/O (not SPI)
Slave select input
10
SS input for mode fault
Slave select input
1
Automatic SS output
Slave select input
76543210
R
000
MODFEN
BIDIROE
0
SPISWAI
SPC0
W
Reset
00000000
= Unimplemented or Reserved
Figure 15-6. SPI Control Register 2 (SPIC2)
Table 15-1. SPIC1 Field Descriptions (continued)
Field
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC9S08SG32E1JTGR | MICROCONTROLLER, PDSO20 |
| MC9S08SG32E1WTL | MICROCONTROLLER, PDSO20 |
| MC9S08SG16E1CTLR | MICROCONTROLLER, PDSO28 |
| MC9S08SG16E1JTJ | MICROCONTROLLER, PDSO28 |
| MC9S08SG32E1MTGR | MICROCONTROLLER, PDSO20 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC9S08SG4 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SG8 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SG8_09 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SG8_12 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC9S08SG8 |
| MC9S08SG8CXXE | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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