15.15 SIOP " />
參數資料
型號: MC705JJ7CDWE
廠商: Freescale Semiconductor
文件頁數: 62/164頁
文件大小: 0K
描述: IC MCU 8BIT 224B RAM 20-SOIC
標準包裝: 38
系列: HC05
核心處理器: HC05
芯體尺寸: 8-位
速度: 2.1MHz
連通性: SIO
外圍設備: POR,溫度傳感器,WDT
輸入/輸出數: 14
程序存儲器容量: 6KB(6K x 8)
程序存儲器類型: OTP
RAM 容量: 224 x 8
電壓 - 電源 (Vcc/Vdd): 2.7 V ~ 5.5 V
數據轉換器: A/D 4x12b
振蕩器型: 內部
工作溫度: -40°C ~ 85°C
封裝/外殼: 20-SOIC(0.295",7.50mm 寬)
包裝: 管件
Electrical Specifications
MC68HC705JJ7 MC68HC705JP7 Advance Information Data Sheet, Rev. 4.1
154
Freescale Semiconductor
15.15 SIOP Timing (VDD = 3.0 Vdc)
15.16 Reset Characteristics
Figure 15-12. Typical Falling Low Voltage Reset
Characteristic(1)
1. +2.7
≤ VDD ≤ +3.3 V, VSS = 0 V, TL ≤ TA ≤ TH, unless otherwise noted
Symbol
Min
Typ
Max
Unit
Frequency of operation
Master
Slave
fSIOP(M)
fSIOP(S)
0.25 x fOP
dc
0.25 x fOP
0.25 x fOP
525
kHz
Cycle time
Master
Slave
tSCK(M)
4.0 x tcyc
4.0 x tcyc
4.0 x tcyc
1.9
s
Clock (SCK) low time (fOP = 2.1 MHz)
tSCKL
1905
ns
SDO data valid time
tV
400
ns
SDO hold time
tHO
0—
ns
SDI setup time
tS
200
ns
SDI hold time
tH
200
ns
Characteristic(1)
1. +2.7
≤ VDD ≤ +3.3 V, VSS = 0 V, TL ≤ TA ≤ TH, unless otherwise noted
Symbol
Min
Typ
Max
Unit
Low-voltage reset
Rising recovery voltage
Falling reset voltage
LVR hysteresis
VLVRR
VLVRF
VLVRH
2.4
2.3
30
3.4
3.3
70
4.4
4.3
V
mV
POR recovery voltage(2)
2. By design, not tested
VPOR
0
100
mV
POR VDD slew rate
(2)
Rising(2)
Falling(2)
SVDDR
SVDDF
0.1
0.05
V/
s
RESET pulse width (when bus clock active)
tRL
1.5
tCYC
RESET pulldown pulse width from internal reset
tRPD
3—4
tCYC
2.5
3
3.5
4
4.5
–45
–35
–25
–15
–5
5
1525354555
65758595
TEMPERATURE IN
°C
RES
ET
VOLTAGE
IN
VOL
T
S
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PDF描述
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