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    <ins id="hwmld"><sub id="hwmld"></sub></ins>
            
    
    
    參數(shù)資料
    型號: MC68HC11E9FU3
    廠商: MOTOROLA INC
    元件分類: 微控制器/微處理器
    英文描述: Microcontrollers
    中文描述: 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PQFP64
    封裝: QFP-64
    文件頁數(shù): 85/268頁
    文件大?。?/td> 3696K
    代理商: MC68HC11E9FU3
    第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁當(dāng)前第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁
    Central Processor Unit (CPU)
    Instruction Set
    M68HC11E Family — Rev. 5
    Data Sheet
    MOTOROLA
    Central Processor Unit (CPU)
    For More Information On This Product,
    Go to: www.freescale.com
    85
    LSR (opr)
    Logical Shift
    Right
    EXT
    IND,X
    IND,Y
    INH
    74
    64
    64
    44
    18
    hh ll
    ff
    ff
    6
    6
    7
    2
    0
    LSRA
    Logical Shift
    Right A
    A
    0
    LSRB
    Logical Shift
    Right B
    B
    INH
    54
    2
    0
    LSRD
    Logical Shift
    Right Double
    INH
    04
    3
    0
    MUL
    Multiply 8 by 8
    Two’s
    Complement
    Memory Byte
    Two’s
    Complement
    A
    Two’s
    Complement
    B
    No operation
    OR
    Accumulator
    A (Inclusive)
    A
    B
    D
    0 – M
    M
    INH
    EXT
    IND,X
    IND,Y
    INH
    3D
    70
    60
    60
    40
    10
    6
    6
    7
    2
    NEG (opr)
    18
    hh ll
    ff
    ff
    NEGA
    0 – A
    A
    A
    NEGB
    0 – B
    B
    B
    INH
    50
    2
    NOP
    No Operation
    A + M
    A
    INH
    IMM
    DIR
    EXT
    IND,X
    IND,Y
    IMM
    DIR
    EXT
    IND,X
    IND,Y
    INH
    01
    8A
    9A
    BA
    AA
    AA
    CA
    DA
    FA
    EA
    EA
    36
    2
    2
    3
    4
    4
    5
    2
    3
    4
    4
    5
    3
    0
    ORAA (opr)
    A
    A
    A
    A
    A
    B
    B
    B
    B
    B
    18
    ii
    dd
    hh ll
    ff
    ff
    ii
    dd
    hh ll
    ff
    ff
    ORAB (opr)
    OR
    Accumulator
    B (Inclusive)
    B + M
    B
    18
    0
    PSHA
    Push A onto
    Stack
    Push B onto
    Stack
    Push X onto
    Stack (Lo
    First)
    Push Y onto
    Stack (Lo
    First)
    Pull A from
    Stack
    Pull B from
    Stack
    Pull X From
    Stack (Hi
    First)
    Pull Y from
    Stack (Hi
    First)
    Rotate Left
    A
    Stk,SP = SP – 1 A
    PSHB
    B
    Stk,SP = SP – 1 B
    INH
    37
    3
    PSHX
    IX
    Stk,SP = SP – 2
    INH
    3C
    4
    PSHY
    IY
    Stk,SP = SP – 2
    INH
    18
    3C
    5
    PULA
    SP = SP + 1, A
    Stk A
    INH
    32
    4
    PULB
    SP = SP + 1, B
    Stk B
    INH
    33
    4
    PULX
    SP = SP + 2, IX
    Stk
    INH
    38
    5
    PULY
    SP = SP + 2, IY
    Stk
    INH
    18
    38
    6
    ROL (opr)
    EXT
    IND,X
    IND,Y
    INH
    79
    69
    69
    49
    18
    hh ll
    ff
    ff
    6
    6
    7
    2
    ROLA
    Rotate Left A
    A
    ROLB
    Rotate Left B
    B
    INH
    59
    2
    ROR (opr)
    Rotate Right
    EXT
    IND,X
    IND,Y
    76
    66
    66
    18
    hh ll
    ff
    ff
    6
    6
    7
    Table 4-2. Instruction Set (Sheet 5 of 7)
    Mnemonic
    Operation
    Description
    Addressing
    Mode
    Instruction
    Operand
    Condition Codes
    H
    I
    Opcode
    Cycles
    S
    X
    N
    Z
    V
    C
    C
    0
    b7
    b0
    C
    0
    b7
    b0
    C
    0
    b7
    b0
    C
    0
    b7
    b0
    A
    B
    b7
    b0
    C
    b7
    b0
    C
    b7
    b0
    C
    b7
    b0
    C
    b7
    b0
    F
    Freescale Semiconductor, Inc.
    n
    .
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