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參數(shù)資料
| 型號(hào)： | MC68HC08RC16DW |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, MICROCONTROLLER, PDSO28 |
| 封裝： | SOIC-28 |
| 文件頁(yè)數(shù)： | 3/200頁(yè) |
| 文件大?。?/td> | 1856K |
| 代理商： | MC68HC08RC16DW |
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Technical Data
MC68HC08RC16 — Rev. 1.0
100
Mask Option Register (MOR)
MOTOROLA
Mask Option Register (MOR)
10.3 Functional Description
The MOR is a read-only register. A write to this location will have no
effect.
ROMSEC — ROM Security Bit
ROMSEC enables the ROM security feature. Setting the ROMSEC
prevents unauthorized reading of the ROM contents. Access is
denied to unauthorized users of customer specific software.
1 = ROM security enabled
0 = ROM security disabled
SSREC — Short Stop Recovery Bit
SSREC enables the CPU to exit stop mode with a delay of 32
CGMXCLK cycles instead of a 4096 CGMXCLK cycle delay.
1 = Stop mode recovery after 32 CGMXCLK cycles
0 = Stop mode recovery after 4096 CGMXCLKC cycles
NOTE:
Exiting stop mode by pulling reset will result in the long stop recovery.
If using an external crystal oscillator, do not set the SSREC bit.
The LVI has an enable time of tEN. The standard system stabilization
time for power on reset and long stop recovery (both 4096 CGMXCLK
cycles) gives a delay longer than the LVI enable time for these startup
scenarios. There is no period where the MCU is not protected from a
low-power condition. However, when using the short stop recovery
configuration option, the 32 CGMXCLK delay must be greater than the
LVI’s turn on time to avoid a period in startup where the LVI is not
protecting the MCU.
Address:
$001F
Bit 7
654321
Bit 0
Read:
0
ROMSEC
SSREC
COPRS
STOP
COPD
Write:
Reset:
Unaffected by reset
= Unimplemented
Figure 10-1. Mask Option Register (MOR)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC68HC11A8BVFN2 | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQCC52 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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