參數(shù)資料
型號: MC68HC08RC16DW
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, MICROCONTROLLER, PDSO28
封裝: SOIC-28
文件頁數(shù): 187/200頁
文件大?。?/td> 1856K
代理商: MC68HC08RC16DW
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Low-Power Modes
Exiting Stop Mode
MC68HC08RC16 — Rev. 1.0
Technical Data
MOTOROLA
Low-Power Modes
87
Carrier modulator transmitter module (CMT) interrupt — A CPU
interrupt request from the CMT module (end of cycle detect) loads
the program counter with the contents of $FFF8 and $FFF9.
Timer interface module (TIM0I) interrupt — A CPU interrupt
request from the TIM0I (TIM0I overflow) loads the program
counter with the contents of $FFF6 and $FFE7.
Keyboard module (KBI) interrupt — A CPU interrupt request from
the KBI module loads the program counter with the contents of
$FFF4 and $FFF5.
7.15 Exiting Stop Mode
These events restart the system clocks and load the program counter
with the reset vector or with an interrupt vector:
External reset — A logic 0 on the RST pin resets the MCU and
loads the program counter with the contents of locations $FFFE
and $FFFF.
External interrupt — A high-to-low transition on an external
interrupt pin loads the program counter with the contents of
locations:
$FFFA and $FFFB (IRQ1 pin)
$FFF4 and $FFF5 (keyboard interrupt pins)
Break interrupt — A break interrupt loads the program counter
with the contents of locations $FFFC and $FFFD.
Upon exit from stop mode, the system clocks begin running after the
system stabilization delay. A 12-bit stop recovery counter inhibits the
system clocks for 4096 CGMXCLK cycles after the reset or external
interrupt.
During this stabilization period, the LVI is enabled and a low VDD will
force entry into the low-power reset mode.
The short stop recovery bit, SSREC, in the configuration register
controls the system stabilization delay during stop recovery. When the
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