參數(shù)資料
型號(hào)： MC68HC08RC16DW
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, MICROCONTROLLER, PDSO28
封裝： SOIC-28
文件頁(yè)數(shù)： 22/200頁(yè)
文件大?。?/td> 1856K
代理商： MC68HC08RC16DW
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Technical Data
MC68HC08RC16 — Rev. 1.0
118
Carrier Modulator Transmitter (CMT)
MOTOROLA
Carrier Modulator Transmitter (CMT)
12.5 Carrier Generator
The carrier signal is generated by counting a register-selected number
of input clocks (250 ns for an 8-MHz oscillator) for both the carrier high
time and the carrier low time. The period is determined by the total
number of clocks counted. The duty cycle is determined by the ratio of
high time clocks to total clocks counted. The high and low time values
are user programmable and are held in two registers.
An alternate set of high/low count values is held in another set of
registers to allow the generation of dual frequency FSK (frequency shift
keying) protocols without CPU intervention.
NOTE:
Data values for the high and low times should be non-zero to prevent
spurious operation.
Table 12-2. CMT Modes of Operation
Mode
MCGEN
Bit(1)
BASE
Bit(2)
MODE
Bit(2)
EXSPC
Bit
Comment
Time
1
0
fcg controlled by primary high and low registers.
fcg transmitted to IRO pin when modulator gate is
open.
Baseband
1
0
fcg is always high. IRO pin high when modulator
gate is open.
FSK
1
0
1
0
fcg control alternates between primary high/low
registers and secondary high/low registers.
fcg transmitted to IRO pin when modulator gate is
open.
Extended space
1
x
1
Setting the EXSPC bit causes subsequent
modulator cycles to be spaces (modulator out not
asserted) for the duration of the modulator period
(mark and space times).
IRO latch
0
x
IRO latch controls state of IRO pin. The IRO latch
can be written to on positive or negative edge of
internal bus clock.
1. To prevent spurious operation, initialize all data and control registers before beginning a transmission (MCGEN = 1).
2. These bits are not double buffered and should not be changed during a transmission (while MCGEN = 1).
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PDF描述
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