參數(shù)資料
型號: MC68HC08JT8
廠商: 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述: M68HC08 Microcontrollers
中文描述: M68HC08系列微控制器
文件頁數(shù): 191/286頁
文件大?。?/td> 1204K
代理商: MC68HC08JT8
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Timer Interface Module (TIM)
I/O Registers
MC68HC908JB8MC68HC08JB8MC68HC08JT8 — Rev. 2.3
Technical Data
Freescale Semiconductor
Timer Interface Module (TIM)
191
TSTOP — TIM Stop Bit
This read/write bit stops the TIM counter. Counting resumes when
TSTOP is cleared. Reset sets the TSTOP bit, stopping the TIM
counter until software clears the TSTOP bit.
1 = TIM counter stopped
0 = TIM counter active
NOTE:
Do not set the TSTOP bit before entering wait mode if the TIM is required
to exit wait mode.
TRST — TIM Reset Bit
Setting this write-only bit resets the TIM counter and the TIM
prescaler. Setting TRST has no effect on any other registers.
Counting resumes from $0000. TRST is cleared automatically after
the TIM counter is reset and always reads as logic 0. Reset clears the
TRST bit.
1 = Prescaler and TIM counter cleared
0 = No effect
NOTE:
Setting the TSTOP and TRST bits simultaneously stops the TIM counter
at a value of $0000.
PS[2:0] — Prescaler Select Bits
These read/write bits select either the PTE0/TCLK pin or one of the
seven prescaler outputs as the input to the TIM counter as
Table 11-2
shows. Reset clears the PS[2:0] bits.
Table 11-2. Prescaler Selection
PS2
PS1
PS0
TIM Clock Source
0
0
0
Internal Bus Clock
÷
1
0
0
1
Internal Bus Clock
÷
2
0
1
0
Internal Bus Clock
÷
4
0
1
1
Internal Bus Clock
÷
8
1
0
0
Internal Bus Clock
÷
16
1
0
1
Internal Bus Clock
÷
32
1
1
0
Internal Bus Clock
÷
64
1
1
1
PTE0/TCLK
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PDF描述
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