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參數(shù)資料
| 型號： | MC68HC08AS32AVFU |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Microcontrollers |
| 中文描述： | 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | QFP-64 |
| 文件頁數(shù)： | 137/296頁 |
| 文件大?。?/td> | 2291K |
| 代理商： | MC68HC08AS32AVFU |
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External Interrupt (IRQ)
Functional Description
MC68HC08AS32A — Rev. 1
Data Sheet
MOTOROLA
External Interrupt (IRQ)
137
Interrupt signals on the IRQ pin are latched into the IRQ latch. An interrupt latch
remains set until one of the following actions occurs:
Vector fetch — A vector fetch automatically generates an interrupt
acknowledge signal that clears the latch that caused the vector fetch.
Software clear — Software can clear an interrupt latch by writing to the
appropriate acknowledge bit in the interrupt status and control register
(ISCR). Writing a 1 to the ACK bit clears the IRQ latch.
Reset — A reset automatically clears both interrupt latches.
The external interrupt pin is falling-edge triggered out of reset and is software-
configurable to be both falling-edge and low-level triggered. The MODE bit in the
ISCR controls the triggering sensitivity of the IRQ pin.
When an interrupt pin is edge-triggered only (MODE = 0), the interrupt latch
remains set until a vector fetch, software clear, or reset occurs.
When an interrupt pin is both falling-edge and low-level triggered (MODE = 1), the
interrupt latch remains set until both of the following occur:
Vector fetch or software clear
Return of the interrupt pin to logic 1
The vector fetch or software clear may occur before or after the interrupt pin returns
to logic 1. As long as the pin is low, the interrupt request remains pending. A reset
will clear the latch and the MODE control bit, thereby clearing the interrupt even if
the pin stays low.
When set, the IMASK bit in the ISCR masks all external interrupt requests. A
latched interrupt request is not presented to the interrupt priority logic unless the
corresponding IMASK bit is clear.
NOTE:
The interrupt mask (I) in the condition code register (CCR) masks all interrupt
requests, including external interrupt requests. (See
Figure 8-4
.)
Addr.
Register Name
Bit 7
6
5
4
3
2
1
Bit 0
$001A
IRQ Status and Control Register
(ISCR)
See page 140.
Read:
0
0
0
0
IRQF
0
IMASK
MODE
Write:
ACK
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 8-3. IRQ I/O Register Summary
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC08AS32CAFN | Microcontrollers |
| MC68HC08AS32VAFN | Microcontrollers |
| MC68HC08AS32A | Microcontrollers |
| MC68HC08AS32ACFU | Microcontrollers |
| MC68HC08AS32AFN | Microcontrollers |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC08AZ0 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| MC68HC08AZ0CFU | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| MC68HC08AZ16 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit |
| MC68HC08AZ24 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit |
| MC68HC08AZ32 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information |
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