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參數(shù)資料
| 型號： | MC100EP195FAR2G |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 16/20頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DELAY LINE 1024TAP 32-LQFP |
| 標(biāo)準(zhǔn)包裝： | 2,000 |
| 系列： | 100EP |
| 標(biāo)片/步級數(shù)： | 1024 |
| 功能： | 可編程 |
| 延遲到第一抽頭： | 2.2ns |
| 接頭增量： | 10ps |
| 可用的總延遲： | 2.2ns ~ 12.2ns |
| 獨立延遲數(shù)： | 1 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-LQFP（7x7） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | MC100EP195FAR2GOS |
MC10EP195, MC100EP195
http://onsemi.com
5
D0
D1
D2
D3
D4
D5
D6
D7
D8
D9
IN
512 GD*
0
1
256 GD*
0
1
128 GD*
0
1
64 GD*
0
1
32 GD*
0
1
16 GD*
0
1
8
GD*
0
1
4
GD*
0
1
2
GD*
0
1
GD*
0
1
GD*
0
1
GD*
0
1
Latch
CASCADE
Q
EN
LEN
SET
MIN
SET
MAX
10
BIT
LA
TCH
D10
*GD
=
(GA
TE
DELA
Y)
APPROXIMA
TEL
Y
10
ps
DELA
Y
PER
GA
TE
(MINIMUM
FIXED
DELA
Y
APPROX.
2.2
ns)
V
BB
V
CF
V
EF
Figure 3. Logic Diagram
V
EE
R1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VI-240-MY-F1 | CONVERTER MOD DC/DC 5V 50W |
| AD5241BR10 | IC DGTL POT 256POS 14-SOIC |
| VE-BNF-MY-F4 | CONVERTER MOD DC/DC 72V 50W |
| VE-BNF-MY-F3 | CONVERTER MOD DC/DC 72V 50W |
| VE-BNF-MY-F1 | CONVERTER MOD DC/DC 72V 50W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC100EP195MNG | 功能描述:延遲線/計時元素 BBG ECL PROG DELAY CHIP RoHS:否 制造商:Micrel 功能:Active Programmable Delay Line 傳播延遲時間:1000 ps 工作溫度范圍: 封裝 / 箱體:QFN-24 封裝:Tube |
| MC100EP195MNR4G | 功能描述:延遲線/計時元素 BBG ECL PROG DELAY CHIP RoHS:否 制造商:Micrel 功能:Active Programmable Delay Line 傳播延遲時間:1000 ps 工作溫度范圍: 封裝 / 箱體:QFN-24 封裝:Tube |
| MC100EP196 | 制造商:ONSEMI 制造商全稱:ON Semiconductor 功能描述:3.3V ECL Programmable Delay Chip with FTUNE |
| MC100EP196_06 | 制造商:ONSEMI 制造商全稱:ON Semiconductor 功能描述:3.3V ECL Programmable Delay Chip with FTUNE |
| MC100EP196B | 制造商:ONSEMI 制造商全稱:ON Semiconductor 功能描述:3.3 V ECL Programmable Delay Chip With FTUNE |
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