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參數(shù)資料
| 型號： | MB91F463NCPMC-GSE1 |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP64 |
| 封裝： | 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, LEAD FREE, PLASTIC, LQFP-64 |
| 文件頁數(shù)： | 73/84頁 |
| 文件大小： | 1954K |
| 代理商： | MB91F463NCPMC-GSE1 |
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MB91460N Series
DS07-16607-4E
75
(7) I2C timing
(VCC
= 3.0 V to 3.6 V/ 4.5 V to 5.5 V, VSS = AVSS = 0 V, TA = 40 °C to + 105 °C/40 °C to + 85 °C)
*1 : For use at over 100 kHz, set the peripheral clock to at least 6 MHz.
*2 : R and C are the pull-up resistance and load capacitance of the SCL and SDA lines.
Note : tCLKP is the cycle time of the peripheral clock.
Parameter
Symbol
Pin name Condition
Standard Mode
Fast Mode *1
Unit
Min
Max
Min
Max
SCL clock frequency
fSCL
SDA2,
SDA3,
SCL2,
SCL3
R
= 1 kΩ,
C
= 50 pF*2
0
100
0
400
kHz
“L” width of the SCL clock
tLOW
4.7
1.3
μs
“H” width of the SCL clock
tHIGH
4.0
0.6
μs
Bus free time between STOP
and START conditions
tBUS
4.7
1.3
μs
SCL
↑→
SDA output delay time
tDLDAT
5
×
tCLKP
5
×
tCLKP
ns
Setup time for a repeated
START condition
SCL
↑→ SDA ↓
tSUSTA
4.7
0.6
μs
Hold time for a repeated START
condition
SDA
↓→ SCL ↓
tHDSTA
4.0
0.6
μs
Setup time for STOP condition
SCL
↑→ SDA ↑
tSUSTO
4.0
0.6
μs
SDA data input hold time
SCL
↓ → SDA ↓ ↑
tHDDAT
2
×
tCLKP
2
×
tCLKP
μs
SDA data input setup time
SDA
↓ ↑ → SCL ↑
tSUDAT
250
100
ns
SDA2,
SDA3
SCL2,
SCL3
tLOW
tSUDAT
tHDSTA
tBUS
tHDSTA
tHDDAT
tHIGH
tSUSTA
tSUSTO
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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