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參數(shù)資料
| 型號(hào)： | MB90246APFV |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, LQFP-100 |
| 文件頁(yè)數(shù)： | 63/100頁(yè) |
| 文件大?。?/td> | 1959K |
| 代理商： | MB90246APFV |
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65
MB90246A Series
(3) Bus Read Timing
(AVCC = VCC = 2.7 V to 5.5 V, AVSS = VSS = 0.0 V, TA = –40
°C to +85°C)
N: Stands for the number of wait cycles. With no wait, N is set at “0”. (The number of wait cycles depends on an
automatic wait and external RDY.)
* : For tCYC (cycle time (machine cycle)), see paragraph (4), “Clock output timing.”
Parameter
Symbol
Pin name
Condition
Value
Unit
Remarks
Min.
Max.
Effective address
→
RD
↓ time
tAVRL
A00 to A23
VCC = 5.0 V ±10%
1 tCYC*/2 – 20
—
ns
Effective address
→
effective data input
tAVDV
D15 to D00
—
(N + 1.5)
×
1 tCYC* – 40
ns
RD pulse width
tRLRH
RD
—
(N + 1)
×
1 tCYC* – 25
—ns
RD
↓ → effective data
input
tRLDV
D15 to D00
VCC = 5.0 V ±10%
—
(N + 1)
×
1 tCYC** – 30
ns
RD
↑ → data hold time tRHDX
D15 to D00
—
0—
ns
RD
↑ → address
effective time
tRHAX
A00 to A23
1 tCYC*/2 – 20
—
ns
Effective address
→
CLK
↑ time
tAVCH
CLK,
A00 to A23
1 tCYC*/2 – 25
—
ns
RD
↓ → CLK ↑ time
tRLCL
RD, CLK
1 tCYC*/2 – 25
—
ns
CLK
RD
A00 to A23
D00 to D15
tAVCH
tRLCL
2.4 V
0.8 V
2.4 V
0.8 V
tAVRL
tAVDV
tRLDV
tRHAX
tRHDX
tRLRH
0.8 V
2.4 V
0.8 V
2.2 V
0.8 V
2.2 V
0.8 V
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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