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參數(shù)資料
| 型號： | MB90050PF |
| 廠商： | FUJITSU LTD |
| 元件分類： | 顯示控制器 |
| 英文描述： | On-Screen Display Controller |
| 中文描述： | 35 X 16 CHARACTERS CRT CHAR OR GRPH DSPL CTLR, PQFP48 |
| 封裝： | PLASTIC, QFP-48 |
| 文件頁數(shù)： | 29/41頁 |
| 文件大?。?/td> | 743K |
| 代理商： | MB90050PF |
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MB90050
29
(Continued)
Note : When a reset signal is input (L level signal input to RESET pin) , the screen output control 1 (command 5
to command 0) bits (SDS, UDS and DSP) and the output pin control 1 to 4 (command 12-0 to command 12-
3) bits are initialized to “0”.The color palette setting (command 13-0) and analog level control (command
13-1) bits are internally set to their predetermined initial values.The contents of other register bits, VRAM
and font RAM are undefined. After reset input (release) is completed, set all command and font RAM settings.
Com-
mand
no.
Command code/data
Function
15 to 12 11
10
9
8
7
6
5
4
3
2
1
0
11-0
1011
0
0
FDS FDC
MC
NP2 NP1 NP0
IN1
IN0
IE1
IE0 Sync control 1
11-1
1011
0
1
0
0
VIX
HIX
0
0
VHE
HE
0
0
Sync control 2
11-3
1011
1
1
0
0
0
H2
H1
H0
0
F2
F1
F0
Sync detection control
12-0
1100
0
0
STO BUO VSO HSO CSO VBO FDO DHO DBO DCO Output pin control 1
12-1
1100
0
1
STX BUX VOX HOX COX VBX FDX DHX DBX DCX Output pin control 2
12-2
1100
1
0
STU BUU VSU HSU CSU VBU FDU
0
0
0
Output pin control 3
12-3
1100
1
1
CKO FSO CKS FSS
0
0
PO3 PO2 PO1 PO0 Output pin control 4
13-0
1101
0
0
0
PLV PLY PLC PLM PLD
PL3
PL2
PL1
PL0 Color palette setting
13-1
1101
1
AA2 AA1 AA0
0
0
AD5 AD4 AD3 AD2 AD1 AD0 Analog level control
14-0
1110
0
0
0
0
0
0
0
FRS
0
0
FA1
FA0 Font RAM setting 1
14-1
1110
0
1
0
0
0
0
0
0
0
FR2 FR1 FR0 Font RAM setting 2
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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