參數(shù)資料
型號： MAX5556ESA+T
廠商： Maxim Integrated Products
文件頁數(shù)： 6/17頁
文件大小： 0K
描述： IC DAC STEREO AUDIO 8-SOIC
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 2,500
位數(shù)： 16
數(shù)據(jù)接口： I²S，串行
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 單電源
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 8-SOIC
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 2 電壓，單極
采樣率（每秒）： 50k
MAX5556
Low-Cost Stereo Audio DAC
14
Maxim Integrated
Power-Up
Once the MAX5556 recognizes a valid MCLK/LRCLK
ratio (256, 384, or 512), the analog outputs (OUTR and
OUTL) are enabled in stages using a glitchless ramping
routine. First, the outputs ramp up to the quiescent out-
put voltage at a rate of 5V/s typ (see Figure 11). After the
outputs reach the quiescent voltage, the converted data
stream begins soft-start ramping, achieving the full-scale
operation over a 20ms period.
If invalid clock signals are detected while the outputs
are DC ramping to their quiescent state, the outputs
stop ramping and hold their preset values until valid
clock signals are restored (Figure 12).
TIME
OUTPUT
VOLTAGE
(OUTR OR OUTL)
VOUT_ RAMPS UP
TO QUIESCENT
VOLTAGE AT 5V/s (TYP)
VOUT_ BEGINS TO
FOLLOW THE DATA. THE
AMPLITUDE IS RAMPED
TO FULL SCALE (20ms TYP)
VALID MCLK/LRCLK RATIO
DETECTED
VOUT_ SETTLES AT
QUIESCENT VOLTAGE (2.4V)
Figure 11. Power-Up Sequence
TIME
OUTPUT
VOLTAGE
(OUTR OR OUTL)
INVALID CLOCK
CONDITION
MUTE: VOUT_ IMMEDIATELY
FORCED TO DC QUIESCENT
LEVEL (2.4V)
VALID MCLK/LRCLK
RE-ESTABLISHED AND MCLK
EQUAL OR GREATER THAN
MINIMUM OPERATING FREQUENCY
VOUT_ SOFT-START
RAMPING (20ms TYP)
Figure 12. Invalid Clock Output Response
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PDF描述
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參數(shù)描述
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MAX555CCB-D 功能描述:數(shù)模轉(zhuǎn)換器- DAC 300Msps 12-Bit DAC with Complementary Voltage Outputs RoHS:否 制造商:Texas Instruments 轉(zhuǎn)換器數(shù)量:1 DAC 輸出端數(shù)量:1 轉(zhuǎn)換速率:2 MSPs 分辨率:16 bit 接口類型:QSPI, SPI, Serial (3-Wire, Microwire) 穩(wěn)定時間:1 us 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:SOIC-14 封裝:Tube
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