參數(shù)資料
型號： MAX1449EHJ+T
廠商： Maxim Integrated Products
文件頁數(shù)： 5/21頁
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描述： IC ADC 10BIT 105MSPS 32-TQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 2,500
位數(shù)： 10
采樣率（每秒）： 105M
數(shù)據(jù)接口： 并聯(lián)
轉(zhuǎn)換器數(shù)目： 1
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-TQFP
供應(yīng)商設(shè)備封裝： 32-TQFP（5x5）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 2 個單端，雙極；1 個差分，雙極
MAX1449
10-Bit, 105Msps, Single 3.3V, Low-Power
ADC with Internal Reference
______________________________________________________________________________________
13
50
58
74
66
82
90
35
49
42
56
63
70
CLOCK DUTY CYCLE (%)
SFDR
(dBc)
fIN = 25.123MHz AT -0.5dB FS
Figure 3a. Spurious Free Dynamic Range vs. Clock Duty Cycle
(Differential Input)
54
57
56
55
60
58
59
61
62
35
49
42
56
63
70
CLOCK DUTY CYCLE (%)
SNR
(dB)
fIN = 25.123MHz AT -0.5dB FS
Figure 3b. Signal-to-Noise Ratio vs. Clock Duty Cycle
(Differential Input)
-85
-75
-80
-65
-70
-55
-60
-50
35
49
42
56
63
70
CLOCK DUTY CYCLE (%)
THD
(dBc)
fIN = 25.123MHz AT -0.5dB FS
Figure 4a. Total Harmonic Distortion vs. Clock Duty Cycle
(Differential Input)
52
56
54
60
58
62
64
35
49
42
56
63
70
CLOCK DUTY CYCLE (%)
SINAD
(dB)
fIN = 25.123MHz AT -0.5dB FS
Figure 4b. Signal-to-Noise Plus Distortion vs. Clock Duty Cycle
(Differential Input)
OUTPUT
DATA D9–D0
OE
tDISABLE
tENABLE
HIGH-Z
VALID DATA
Figure 5. Output Enable Timing
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PDF描述
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參數(shù)描述
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