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參數(shù)資料
| 型號： | M5M4V64S30ATP-10L |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | 64M (4-BANK x 2097152-WORD x 8-BIT) Synchronous DRAM |
| 中文描述： | 64M號（4銀行甲2097152字× 8位）同步DRAM |
| 文件頁數(shù)： | 35/51頁 |
| 文件大?。?/td> | 1082K |
| 代理商： | M5M4V64S30ATP-10L |
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MITSUBISHI LSIs
MITSUBISHI ELECTRIC
A0-8
A10
DQM
A9,11
Mar'98
SDRAM (Rev.1.3)
64M (4-BANK x 2097152-WORD x 8-BIT) Synchronous DRAM
M5M4V64S30ATP-8A,-8L,-8, -10L, -10
Burst Read (multiple bank) @BL=4 CL=3
/CS
/RAS
/CAS
/WE
CKE
BA0,1
DQ
X
X
X
0
Y
0
0
Q0
Q0
Q0
Q0
X
X
X
0
Y
0
Q0
ACT#0
READ#0
PRE#0
ACT#0
PRE#1
READ#0
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
tRCD
tRAS
tRP
tRC
tRCD
CL=3
DQM read latency =2
tRRD
X
X
X
1
ACT#1
Y
1
tRRD
Q1
Q1
Q1
Q1
X
X
X
2
1
CL=3
READ#1
ACT#2
CLK
35
Italic parameter
indicates minimum case
相關PDF資料 |
PDF描述 |
|---|---|
| M5M4V64S30ATP-10 | Octal D-Type Transparent Latches With 3-State Outputs 20-TSSOP -40 to 85 |
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| M5M4V64S30ATP-8A | Octal D-Type Edge-Triggered Flip-Flops with 3-State Outputs 20-SOIC -40 to 85 |
| M5M4V64S30ATP-8L | Octal D-Type Edge-Triggered Flip-Flops with 3-State Outputs 20-SOIC -40 to 85 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| M5M4V64S30ATP-8L | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:64M (4-BANK x 2097152-WORD x 8-BIT) Synchronous DRAM |
| M5M4V64S40ATP-10 | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:64M (4-BANK x 1048576-WORD x 16-BIT) Synchronous DRAM |
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