參數(shù)資料
型號： M30600E8-XXXGP
元件分類： 微控制器/微處理器
英文描述： 16-BIT, MROM, MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100
文件頁數(shù)： 39/139頁
文件大小： 1782K
代理商： M30600E8-XXXGP
Mitsubishi microcomputers
M16C / 60 Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
Timing (Vcc = 3V)
133
Memory Expansion Mode and Microprocessor Mode
(When accessing external memory area with wait, and select multiplexed bus)
Read timing
Write timing
Measuring conditions :
VCC = 3V
Input timing voltage : Determined with VOL = 0.48V, VOH = 1.5V
Output timing voltage : Determined with VIL = 1.5V, VIH = 1.5V
BCLK
CSi
ALE
RD
4ns.min
ADi
BHE
ADi
/DBi
Address
BCLK
CSi
ALE
ADi
BHE
ADi
/DBi
Address
Data input
Address
WR,WRL,
WRH
Data input
Address
th(BCLK–AD)
td(BCLK–CS)
60ns.max
td(BCLK–AD)
60ns.max
–4ns.min
60ns.max
0ns.min
th(BCLK–CS)
4ns.min
tcyc
th(RD–AD)
tSU(DB–RD)
80ns.min
th(RD–DB)
0ns.min
td(AD–ALE)
(tcyc/2)ns.min
th(RD–CS)
(tcyc/2)ns.min
(tcyc/2–60)ns.min
td(BCLK–ALE)
tac3(RD–DB)
th(ALE–AD)
50ns.min
tdz(RD–AD)
8ns.max
td(AD–RD)
0ns.min
th(BCLK–RD)
td(BCLK–RD)
th(BCLK–ALE)
th(BCLK–WR)
0ns.min
td(BCLK-CS)
60ns.max
td(BCLK–AD)
60ns.max
th(BCLK–ALE)
–4ns.min
th(BCLK–AD)
th(BCLK–CS)
4ns.min
tcyc
th(WR–AD)
td(BCLK-DB)
80ns.max
th(BCLK–DB)
4ns.min
td(DB–WR)
(tcyc*3/2–80)ns.min
(tcyc/2)ns.min
td(AD–ALE)
(tcyc/2–60)ns.min
(tcyc/2)ns.min
td(BCLK–ALE)
td(BCLK–WR)
4ns.min
0ns.min
td(AD–WR)
60ns.max
th(WR–DB)
th(WR–CS)
VCC = 3V
相關(guān)PDF資料
PDF描述
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