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參數(shù)資料
| 型號： | M30218MA |
| 廠商： | Mitsubishi Electric Corporation |
| 元件分類： | RS-232 |
| 英文描述： | 5V High-Speed RS-232 Transceivers with 0.1uF Capacitors |
| 中文描述： | 5V的高速RS - 232收發(fā)器與0.1uF電容 |
| 文件頁數(shù)： | 340/467頁 |
| 文件大小： | 4984K |
| 代理商： | M30218MA |
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326
A-D Converter
M
i
t
s
u
M
S
b
i
s
3
M
h
0
I
C
i
m
2
R
i
1
O
c
r
8
C
o
c
o
G
M
m
p
r
P
u
t
u
T
e
r
p
R
s
o
U
S
I
N
G
L
E
-
C
H
I
P
1
6
-
B
I
T
C
M
O
O
E
2.8 A-D Converter
Table 2.8.1. Conversion time every operation clock
Frequency selection bit 1
Note 1: The number of conversion cycles per one analog input pin.
Note 2: The conversion time per one analog input pin (when f
AD
= f(X
IN
) = 10 MHz)
2.8.1 Overview
The A-D converter used in the M30218 group operates on a successive conversion basis. The following
is an overview of the A-D converter.
(1) Mode
The A-D converter operates in one of five modes:
(a) One-shot mode
Carries out A-D conversion on input level of one specified pin only once.
(b) Repetition mode
Repeatedly carries out A-D conversion on input level of one specified pin.
(c) One-shot sweep mode
Carries out A-D conversion on input level of two or more specified pins only once.
(d) Repeated sweep mode 0
Repeatedly carries out A-D conversion on input level of two or more pins.
(e) Repeated sweep mode 1
Repeatedly carries out A-D conversion on input level of two or more pins. This mode is different from
the repeated sweep mode 0 in that weights can be assigned to specifing pins control the number of
conversion times.
(2) Operation clock
The operation clock can be selected from the following: f
AD
, divide-by-2 f
AD
, and divide-by-4 f
AD
. The
f
AD
frequency is equal to that of the CPU’s main clock.
(3) Conversion time
Number of conversion for A-D convertor varies depending on resolution as given. Table 2.8.1 shows
relation between the A-D converter operation clock and conversion time.
Sample & Hold function selected:
33 cycles for 10-bit resolution, or 28 cycles for 8-bit resolution
No Sample & Hold function:
59 cycles for 10-bit resolution, or 49 cycles for 8-bit resolution
Frequency selection bit 0
A-D converter's operation clock
Min. conversion
cycles (Note 1)
Min. conversion
time (Note 2)
8-bit mode
8-bit mode
10-bit mode
10-bit mode
0
1
φ
AD
=
4
f
AD
φ
AD
=
2
f
AD
28 X
φ
AD
33 X
φ
AD
11.2μs
13.2μs
6.6μs
5.6μs
0
1
Invalid
φ
AD
= f
AD
2.8μs
3.3μs
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