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參數(shù)資料
| 型號(hào)： | M30201M2 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單片16位CMOS微機(jī) |
| 文件頁數(shù)： | 13/159頁 |
| 文件大?。?/td> | 2319K |
| 代理商： | M30201M2 |
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Unde
CPU
deeopmen
Mitsubishi microcomputers
M30201 Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
13
Bit 7: Stack pointer select flag (U flag)
Interrupt stack pointer (ISP) is selected when this flag is “0” ; user stack pointer (USP) is selected
when this flag is “1”.
This flag is cleared to “0” when a hardware interrupt is acknowledged or an INT instruction of software
interrupt Nos. 0 to 31 is executed.
Bits 8 to 11: Reserved area
Bits 12 to 14: Processor interrupt priority level (IPL)
Processor interrupt priority level (IPL) is configured with three bits, for specification of up to eight
processor interrupt priority levels from level 0 to level 7.
If a requested interrupt has priority greater than the processor interrupt priority level (IPL), the interrupt
is enabled.
Bit 15: Reserved area
The C, Z, S, and O flags are changed when instructions are executed. See the software manual for
details.
Figure 1.10. Flag register (FLG)
AAAAAAA
AAAAAAA
R0
(Note)
L
b15
b8
b7
b0
AAAAAAA
AAAAAAA
H
R1
(Note)
L
R2
(Note)
AAAAAAA
AAAAAAA
R3
(Note)
AAAAAAA
AAAAAAA
b15
b0
A0
(Note)
AAAAAAA
AAAAAAA
AAAAAAA
b15
b0
A1
(Note)
AAAAAAA
b15
b0
FB
(Note)
AAAAAAA
AAAAAAA
b15
b0
Data
registers
Address
registers
Frame base
registers
b15
b0
b15
b0
b15
b0
b15
b0
b0
b19
b0
b19
H
L
Program coun
Interrupt table
register
User stack po
Interrupt stack
pointer
Static base
register
Flag register
PC
INTB
USP
ISP
SB
FLG
B
O
I
U
AAAAAAAAAAAAAA
AAAAAAAAAAAAAA
Z
S
D
C
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PDF描述 |
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