參數(shù)資料
型號(hào)： LFX125EB-03F256I
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 82/119頁
文件大小： 0K
描述： IC FPGA 139K GATES 256-BGA
標(biāo)準(zhǔn)包裝： 90
系列： ispXPGA®
邏輯元件/單元數(shù)： 1936
RAM 位總計(jì)： 94208
輸入/輸出數(shù)： 160
門數(shù)： 139000
電源電壓： 2.3 V ~ 3.6 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 105°C
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-FPBGA（17x17）
Lattice Semiconductor
ispXPGA Family Data Sheet
61
HSImA_CDRRST, HSImB_CDRRST
Input
CDR Reset
HSIm_CSLOCK, HSIm_CSLOCK
Internal Signal Indicates when the CSPLL circuit is locked
sysHSI Block (Source Synchronous Mode)
6
SS_CLKIN0P, SS_CLKIN1P
Input
P-side of differential clock input
SS_CLKIN0N, SS_CLKIN1N
Input
N-side of differential clock input
SS_CLKOUT0P, SS_CLKOUT1P
Output
P-side of differential clock output
SS_CLKOUT0N, SS_CLKOUT1N
Output
N-side of differential clock output
CAL0, CAL1
Input
Initiates source synchronous calibration sequence
1. x is a variable for the I/O number.
2. y is a variable for the I/O Bank.
3. z is a variable for the PLL number.
4. m is a variable for the sysHSI block number.
5. A and B refer to the sysHSI block channels.
6. 0 and 1 refer to Source Synchronous group 0 and 1
7. n is a variable for the GCLK and Input number
8. See Logic Signal Connections Table for differential pairing.
Signal Descriptions
1 (Cont.)
Signal Name
Signal Type
Description
SELECT
DEVICES
DISCONTINUED
相關(guān)PDF資料
PDF描述
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ASC40DRTH-S734 CONN EDGECARD 80POS DIP .100 SLD
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參數(shù)描述
LFX125EB-03F516C 功能描述:FPGA - 現(xiàn)場可編程門陣列 139K 176 I/O ispJTAG RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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