參數(shù)資料
型號(hào)： IRU3073CQTR
廠(chǎng)商： International Rectifier
文件頁(yè)數(shù)： 4/21頁(yè)
文件大?。?/td> 236K
描述： IC REG DL BCK/LINEAR 16-QSOP
標(biāo)準(zhǔn)包裝： 1
拓?fù)洌?/td> 降壓（降壓）同步（1），線(xiàn)性（LDO）（1）
功能： 任何功能
輸出數(shù)： 2
頻率 - 開(kāi)關(guān)： 210kHz ~ 400kHz
電壓/電流 - 輸出 1： 控制器
電壓/電流 - 輸出 2： 0.8 V ~ 22.5 V，65mA
帶 LED 驅(qū)動(dòng)器： 無(wú)
帶監(jiān)控器： 無(wú)
帶序列發(fā)生器： 是
電源電壓： 4.4 V ~ 25 V
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 16-SSOP（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： *
包裝： 剪切帶 (CT)
其它名稱(chēng)： *IRU3073CQTR
IRU3073CQCT
4
Rev. 1.0
09/17/03
IRU3073
www.irf.com
Figure 2 - Simplified block diagram of the IRU3073.
This pin serves as the separate ground for MOSFET's driver and should be connected to
system's ground plane.
This pin serves as analog ground for internal reference and control circuitry. A high fre-
quency capacitor must be connected from Vcc pin to this pin for noise free operation.
Output driver for the high side power MOSFET. This pin should not go negative (below
ground), this may cause problem for the gate drive circuit. It can happen when the inductor
current goes negative (Source/Sink), soft-start at no load and for the fast load transient
from full load to no load. To prevent negative voltage at gate drive, a low forward voltage
drop diode might be connected between this pin and ground.
This pin is connected to a voltage that must be at least 4V higher than the bus voltage of
the switcher (assuming 5V threshold MOSFET) and powers the high side output driver. A
minimum of 1mF, high frequency capacitor must be connected from this pin to ground to
provide peak drive current capability.
This pin is connected to the Drain of the lower MOSFET via an external resister and it
provides the positive sensing for the internal current sensing circuitry. The external resis-
tor programs the current limit threshold depending on the RDS(ON) of the power MOSFET.
An external capacitor can be placed in parallel with the programming resistor to provide
high frequency noise filtering.
PIN# PIN SYMBOL PIN DESCRIPTION
12
13
14
15
16
PGnd
Gnd
HDrv
VcH
OCSet
BLOCK DIAGRAM
13
Gnd
20uA
64uA
Max
POR
Oscillator
Error Amp
Ct
Error Comp
Reset Dom
POR
0.4V
FbLo Comp
VcH
HDrv
VcL
LDrv
PGnd
SS/SD
Fb1
Comp
25K
25K
R
S
Q
Rt
Rt
CS Comp
OCSet
3V
20uA
VREF
Drv2
0.8V
Fb2
Bias
Generator
1.25V
3V
POR
VcH
UVLO
3.5V / 3.3V
Vcc
4.2V / 4.0V
VP1
3V
0.8V
8
4
5
7
6
16
1
3
15
14
10
11
12
2
9
Vcc
En
Vcc
1.25V
TSD
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