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參數(shù)資料
| 型號： | INTEL387DX |
| 英文描述： | Intel387 DX - MATH COPROCESSOR |
| 中文描述： | Intel387霉素-數(shù)學(xué)協(xié)處理器 |
| 文件頁數(shù)： | 32/41頁 |
| 文件大?。?/td> | 435K |
| 代理商： | INTEL387DX |
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Intel387
TM
DX MATH COPROCESSOR
Table 4.2c. Timing Requirements of the Bus Interface Unit
(Continued)
T
C
e
0
§
C to
a
85
§
C, V
CC
e
5V
g
5%
(All measurements made at 1.5V and 50 pF unless otherwise specified)
Pin
Symbol
Parameter
16 MHz–33 MHz
Conditions
Test
Reference
Figure
Min (ns)
Max (ns)
PEREQ
(2)
BUSY
Y
(2)
ERROR
Y
(2)
READYO
Y
(2)
t13
t13
t13
t13
Float Time
Float Time
Float Time
Float Time
1
1
1
1
30
30
30
30
4.5
ADS
Y
ADS
Y
W/R
Y
W/R
Y
t14
t15
t14
t15
Setup Time
Hold Time
Setup Time
Hold Time
13
4
13
4
4.3
READY
Y
READY
Y
CMDO
Y
CMDO
Y
NPS1
Y
NPS2
NPS1
Y
NPS2
STEN
STEN
t16
t17
t16
t17
t16
Setup Time
Hold Time
Setup Time
Hold Time
Setup Time
7
4
13
2
13
t17
Hold Time
2
t16
t17
Setup Time
Hold Time
13
2
RESETIN
RESETIN
t18
t19
Setup Time
Hold Time
5
3
4.4
NOTES:
1. Not tested at 25 pF.
2. Float delay is not tested. Float condition occurs when maximum output current becomes less than I
LO
in magnitude.
*
nom - nominal value
240448–14
NOTE:
This graph will not be linear outside of the C
L
range
shown.
Figure 4.0a. Typical Output Valid Delay vs Load
Capacitance at Max Operating Temperature
240448–15
NOTE:
This graph will not be linear outside of the C
L
range
shown.
Figure 4.0b. Typical Output Rise Time vs Load
Capacitance at Max Operating Temperature
32
32
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PDF描述 |
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參數(shù)描述 |
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