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參數(shù)資料
| 型號(hào)： | IDTSSTE32882HLBAKG8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁(yè)數(shù)： | 16/73頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC REGISTERING CLK DRIVER 176BGA |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 時(shí)鐘緩沖器/驅(qū)動(dòng)器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 存儲(chǔ)器，DDR3，RDIMM |
| 輸入： | CMOS |
| 輸出： | CMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 5:60 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 810MHz |
| 電源電壓： | 1.282 V ~ 1.575 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 176-TFBGA |
| 供應(yīng)商設(shè)備封裝： | 176-CABGA（13.5x8） |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | 800-2597-6 |
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1.35V/1.5V REGISTERING CLOCK DRIVER WITH PARITY TEST AND QUAD CHIP SELECT
23
SSTE32882HLB
7201/14
SSTE32882HLB
1.35V/1.5V REGISTERING CLOCK DRIVER WITH PARITY TEST AND QUAD CHIP SELECT
COMMERCIAL TEMPERATURE
Voltage waveforms; input clock
VIX(AC) = 0.5XVDD±175 mV (1.5V operation) or 0.5xVDD±150 mV (1.35 V operation)
IOL
LOW-level output current
ERROUT
25
–
mA
VOD
Differential re-driven clock swing (1.5V Operation)
Yn, Yn
500
–
VDD
mV
Differential re-driven clock swing (1.35V Operation)
Yn, Yn
450
–
VDD
mV
VOX
Differential Output Crosspoint Voltage (1.5V Operation)
Yn, Yn
0.5xVDD – 100
mV
–
0.5xVDD + 100
mV
V
Differential Output Crosspoint Voltage (1.35V Operation)
Yn, Yn
0.5xVDD – 90 mV
–
0.5xVDD + 90 mV
V
DDR3-800
DDR3-1066
DDR3-133
3
DDR3-1600
Tcase
(max)
Case temperature8
1099
1089
1069
1039
oC
1 DCKE0/1, DODT0/1, DA0..DA15, DBA0..DBA2, DRAS, DCAS, DWE, PAR_IN, DCS[1:0] when QCSEN = HIGH, DCS[3:0] when QCSEN = LOW.
2 RESET, MIRROR
3 This spec applies only when both CK and CK are actively driven LOW. It does not apply when CK/CK are floating.
4 Extended range for Vix is only allowed for clock (CK and CK) and if single-ended clock input signals CK and CK are monotonic with a single-ended
swing VSEL / VSEH of at least VDD/2 +/-275 mV, and when the differential slew rate of CK - CK is larger than 4 V/ns.
5 Extended range for Vix is only allowed for clock (CK and CK) and if single-ended clock input signals CK and CK are monotonic with a single-ended
swing VSEL / VSEH of at least VDD/2 +/-243 mV, and when the differential slew rate of CK - CK is larger than 3.6 V/ns
6 VID is the magnitude of the difference between the input level on CK and the input level on CK See Diagram (Voltage waveforms; input clock)
7 Default settings
8 Measurement procedure JESD51-2
9 This spec is meant to guarantee a Tj of 125C by the SSTE32882 device. Since Tj cannot be measured or observed by users, Tcase is specified instead.
Under all thermal condition, the Tj of a SSTE32882 device shall not be higher than 125 oC.
Symbol
Parameter
Signals
Min
Nom
Max
Unit
VIX(AC)
VID
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| V28C15M100B2 | CONVERTER MOD DC/DC 15V 100W |
| VI-J5X-MX-F2 | CONVERTER MOD DC/DC 5.2V 75W |
| D38999/24WJ4PB | CONN RCPT 56POS JAM NUT W/PINS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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