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參數(shù)資料
| 型號： | IDT72V51236L6BB |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 46/56頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FLOW CTRL MULTI QUEUE 256-BGA |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 多隊列流量控制 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BBGA |
| 供應(yīng)商設(shè)備封裝： | 256-BGA（17x17） |
| 包裝： | 托盤 |
| 其它名稱： | 72V51236L6BB |
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50
IDT72V51236/72V51246/72V51256 3.3V, MULTI-QUEUE FLOW-CONTROL DEVICES
(4 QUEUES) 36 BIT WIDE CONFIGURATION 589,824, 1,179,648 and 2,359,296 bits
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
WRADD
WADEN
WCLK
WEN
FSTR
PAFn
FSYNC
FF
PAF
SCLK
RCLK
REN
ESTR
PAEn
ESYNC
OV
PAE
RDADD
RADEN
SO FXO EXO
SI
FXI
EXI
WRADD
WADEN
WCLK
WEN
FSTR
PAFn
FSYNC
FF
PAF
SCLK
RCLK
REN
ESTR
PAEn
ESYNC
OV
PAE
RDADD
RADEN
SO FXO EXO
SI
FXI
EXI
WRADD
WADEN
WCLK
WEN
FSTR
PAFn
FSYNC
FF
PAF
SCLK
RCLK
REN
ESTR
PAEn
ESYNC
OV
PAE
RDADD
RADEN
SENO
FXO
EXO
Q0-Q35
SI
FXI
EXI
Data Bus
Write Clock
Write Enable
Write Queue Select
Full Strobe
Programmable Almost Full
Write Address
Full Sync1
Full Flag
Almost Full Flag
Serial Clock
Output Data Bus
Read Clock
Read Enable
Read Queue Select
Empty Strobe
Programmable Almost Empty
Read Address
Empty Sync 1
Output Valid Flag
Almost Empty Flag
Serial Programming Data Input
DEVICE
1
DEVICE
2
DEVICE
n
Full Sync2
Empty Sync 2
Full Sync n
Empty Sync n
SENO
SENI
SENO
SENI
DONE
5937 drw33
D0-D35
Q0-Q35
D0-D35
Q0-Q35
SENI
PR
Packet Reads
PR
Serial Enable
Figure 30. Multi-Queue Expansion Diagram
NOTES:
1. If devices are configured for Direct operation of the
PAFn/PAEn flag busses the FXI/EXI of the MASTER device should be tied LOW. All other devices tied HIGH. The FXO/EXO
outputs are DNC (Do Not Connect).
2. Q outputs must not be mixed between devices, i.e. Q0 of device 1 must connect to Q0 of device 2, etc.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT72V51246L7-5BB | IC FLOW CTRL MULTI QUEUE 256-BGA |
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| IDT72V51446L7-5BB8 | IC FLOW CTRL MULTI QUEUE 256-BGA |
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參數(shù)描述 |
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