參數(shù)資料
型號： IDT72T54262L5BBI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS
中文描述： 512K X 10 OTHER FIFO, 3.6 ns, PBGA324
封裝： 19 X 19 MM, 1 MM PITCH, PLASTIC, BGA-324
文件頁數(shù)： 22/56頁
文件大?。?/td> 555K
代理商： IDT72T54262L5BBI
22
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T54242/72T54252/72T54262 2.5V QUAD/DUAL TeraSync
DDR/SDR FIFO
32K x 10 x 4/16K x 20 x 2, 64K x 10 x 4/32K x 20 x 2 and 128K x 10 x 4/64K x 20 x 2
MARCH 22, 2005
Figure 5. Bus-Matching in Dual mode
6158 drw10
A
Write to
FIFO 0 and FIFO 2
INPUT PORT BUS-WIDTH x20
OUTPUT PORT BUS-WIDTH x20
B
C
D
H
D39-D30 D29-D20 D19-D10 D9-D0
FIFO 0
FIFO 0
FIFO 2
FIFO 2
A
Read from
FIFO 0 and FIFO 2
B
C
D
D39-D30 D29-D20 D19-D10 D9-D0
FIFO 0
FIFO 0
FIFO 2
FIFO 2
(a) x20 INPUT to x20 OUTPUT
A
1st Read from
FIFO 0 and FIFO 2
C
D39-D30 D29-D20 D19-D10 D9-D0
INPUT PORT BUS-WIDTH x20
OUTPUT PORT BUS-WIDTH x10
B
2nd Read from
FIFO 0 and FIFO 2
D
D39-D30 D29-D20 D19-D10 D9-D0
INPUT PORT BUS-WIDTH x10
OUTPUT PORT BUS-WIDTH x10
(b) x20 INPUT to x10 OUTPUT
A
1st Write to
FIFO 0 and FIFO 2
B
D39-D30 D29-D20 D19-D10 D9-D0
C
2nd Write to
FIFO 0 and FIFO 2
D
D39-D30 D29-D20 D19-D10 D9-D0
FIFO 0
FIFO 0
FIFO 2
FIFO 2
(c) x10 INPUT to x10 OUTPUT
A
1st Read from
FIFO 0 and FIFO 2
B
D39-D30 D29-D20 D19-D10 D9-D0
C
2nd Read from
FIFO 0 and FIFO 2
D
D39-D30 D29-D20 D19-D10 D9-D0
FIFO 0
FIFO 0
FIFO 2
FIFO 2
A
Read from
FIFO 0 and FIFO 2
C
B
D
D39-D30 D29-D20 D19-D10 D9-D0
(d) x10 INPUT to x20 OUTPUT
INPUT PORT BUS-WIDTH x10
OUTPUT PORT BUS-WIDTH x20
IW
OW
H
H
IW
OW
L
L
IW
OW
L
L
IW
OW
H
FIFO 0
FIFO 0
FIFO 2
FIFO 2
FIFO 0
FIFO 0
FIFO 2
FIFO 2
FIFO 0
FIFO 0
FIFO 2
FIFO 2
FIFO 0
FIFO 0
FIFO 2
FIFO 2
FIFO 0
FIFO 0
FIFO 2
FIFO 2
相關(guān)PDF資料
PDF描述
IDT72T54242 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS
IDT72T54242L5BB 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS
IDT72T54242L5BBI 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS
IDT72T54252 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS
IDT72T54252L5BB 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS
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參數(shù)描述
IDT72T54262L6-7BB 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時(shí)間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433
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IDT72T55248L5BB 功能描述:IC CTRL QUADMUX FLOW 324-BGA RoHS:否 類別:集成電路 (IC) >> 專用 IC 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- 類型:調(diào)幀器 應(yīng)用:數(shù)據(jù)傳輸 安裝類型:表面貼裝 封裝/外殼:400-BBGA 供應(yīng)商設(shè)備封裝:400-PBGA（27x27） 包裝:散裝
IDT72T55248L6-7BB 功能描述:IC CTRL QUADMUX FLOW 324-BGA RoHS:否 類別:集成電路 (IC) >> 專用 IC 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- 類型:調(diào)幀器 應(yīng)用:數(shù)據(jù)傳輸 安裝類型:表面貼裝 封裝/外殼:400-BBGA 供應(yīng)商設(shè)備封裝:400-PBGA（27x27） 包裝:散裝
IDT72T55248L6-7BBI 功能描述:IC CTRL QUADMUX FLOW 324-BGA RoHS:否 類別:集成電路 (IC) >> 專用 IC 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- 類型:調(diào)幀器 應(yīng)用:數(shù)據(jù)傳輸 安裝類型:表面貼裝 封裝/外殼:400-BBGA 供應(yīng)商設(shè)備封裝:400-PBGA（27x27） 包裝:散裝
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