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參數(shù)資料
| 型號(hào)： | ICS950818 |
| 英文描述： | Frequency Generator with 200MHz Differential CPU Clocks |
| 中文描述： | 頻率發(fā)生器200MHz的CPU的時(shí)鐘差分 |
| 文件頁(yè)數(shù)： | 18/20頁(yè) |
| 文件大小： | 165K |
| 代理商： | ICS950818 |
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18
ICS950818
0825F—11/19/03
Power Down De-Assertion Mode
The power-up latency needs to be less than 1.8mS. this is the time from the de-asseration of the powerdown of the
ramping of the power supply until the time that stable clocks are output from the clock chip. If the SMBus Bit 6 of Byte
0 is programmed to "1" then the stopped CPU outputs will be driven high within 3 nS of PD# de-asseration.
Test Configuration Diagram
CPU 0.7V Configuration test load board termination
TLA
TLB
MULTSEL Pin must be High
Rs=33 Ohms
5%
Rs=33 Ohms
5%
Rp=49.9 Ohms
1%
Rp=49.9 Ohms
1%
Rset=475 Ohms
1%
2pF
5%
2pF
5%
CPUCLKT test
point
CPUCLKC test
point
CLK408
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS950901 | Programmable Timing Control Hub for P4 |
| ICS950901YFLFT | TRIMMER, 500K |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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