參數(shù)資料
型號(hào)： HW-V5GBE-DK-UNI-G-PROMO1
廠商： Xilinx Inc
文件頁(yè)數(shù)： 77/91頁(yè)
文件大小： 0K
描述： KIT DEV V5 LXT GIGABIT ETHERNET
產(chǎn)品變化通告： Product Notice_Dev Systems Product
標(biāo)準(zhǔn)包裝： 1
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
79
Table 96: Global Clock Setup and Hold With DCM and PLL in System-Synchronous Mode
Symbol
Description
Device
Speed Grade
Units
-3
-2
-1
Input Setup and Hold Time Relative to Global Clock Input Signal for LVCMOS25 Standard.(1)
TPSDCMPLL/
TPHDCMPLL
No Delay Global Clock and IFF(2) with
DCM and PLL in System-Synchronous Mode
XC5VLX20T
N/A
1.67
–0.64
1.78
–0.64
ns
XC5VLX30
1.72
–0.58
1.89
–0.58
2.07
–0.58
ns
XC5VLX30T
1.72
–0.58
1.89
–0.58
2.06
–0.58
ns
XC5VLX50
1.69
–0.56
1.86
–0.56
2.04
–0.56
ns
XC5VLX50T
1.69
–0.56
1.86
–0.56
2.04
–0.56
ns
XC5VLX85
1.74
–0.51
1.93
–0.51
2.13
–0.51
ns
XC5VLX85T
1.74
–0.51
1.93
–0.51
2.13
–0.51
ns
XC5VLX110
1.73
–0.45
1.93
–0.45
2.13
–0.45
ns
XC5VLX110T
1.73
–0.45
1.93
–0.45
2.13
–0.45
ns
XC5VLX155
2.14
–0.40
2.31
–0.40
2.55
–0.40
ns
XC5VLX155T
2.14
–0.40
2.31
–0.40
2.55
–0.40
ns
XC5VLX220
N/A
2.32
–0.35
2.61
–0.35
ns
XC5VLX220T
N/A
2.32
–0.35
2.61
–0.35
ns
XC5VLX330
N/A
2.29
–0.18
2.60
–0.18
ns
XC5VLX330T
N/A
2.32
–0.18
2.61
–0.18
ns
XC5VSX35T
1.78
–0.47
1.97
–0.47
2.16
–0.47
ns
XC5VSX50T
1.76
–0.45
1.94
–0.45
2.14
–0.45
ns
XC5VSX95T
N/A
2.51
–0.49
2.53
–0.49
ns
XC5VSX240T
N/A
2.39
–0.18
2.70
–0.18
ns
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