3-3
Cartesian to Polar Converter
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FIGURE 28. PHASE BIT MAPPING OF COORDINATE CONVERTER OUTPUT
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Frequency Discriminator
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FIGURE 29. FREQUENCY DISCRIMINATOR BLOCK DIAGRAM
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Output Section
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Parallel Direct Output Port Mode
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Data Transitions:. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 30. PARALLEL OUTPUT BLOCK DIAGRAM
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Data Ready Signal Assertion Rate: . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 31. DATARDY WAVEFORMS WHEN I (READ DATA) IS SELECTED AS AOUT
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 32. DATARDY WAVEFORMS WHEN |r| (MAGNITUDE) IS SELECTED AS AOUT
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 33. DATARDY WAVEFORMS WHEN f (FREQUENCY) IS SELECTED AS AOUT
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Serial Direct Output Port Mode
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FIGURE 34. SERIAL OUTPUT FORMATTER BLOCK DIAGRAM
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Serial Output Configuration Example 1:
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Serial Output Configuration Example 2:. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 35. EXAMPLE 2 SERIAL OUTPUT DATA STREAM
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 36. VALID SERSYNC CONFIGURATION OPTIONS
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Buffer RAM Output Port
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FIFO Operation via 16-Bit
μ
Processor Interface
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FIGURE 37. 16-BIT MICROPROCESSOR INTERFACE BUFFER RAM MODE BLOCK DIAGRAM
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 38. INTERFACE BETWEEN A 16-BIT MICROPROCESSOR AND PDC IN FIFO BUFFER RAM MODE
. . . . . . . . . . . . . . . . . . . . . .
FIGURE 39. TIMING DIAGRAM FOR PDC IN FIFO MODE WITH OUTPUTS I, Q, AND FREQUENCY SENT TO AOUT(7:0) AND BOUT(7:0)
. .
FIGURE 40. FIFO REGISTER OPERATION
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIFO Operation via 8-Bit
μ
Processor Interface
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 41. 8-BIT MICROPROCESSOR INTERFACE BUFFER RAM MODE BLOCK DIAGRAM
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 42. RAM LOAD SEQUENCE
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Snap Shot Operation
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FIGURE 43. SNAP SHOT SAMPLING
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Avoiding Timing Pitfalls When Using the Buffer RAM Output Port . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 44. AVOIDING FALSE INTRRP ASSERTIONS
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Microprocessor Write Section
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FIGURE 45. LOADING THE CONTROL REGISTERS WITH 32-BIT CONTROL WORDS
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Microprocessor Read Section
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FIGURE 46. READING THE CONTROL REGISTERS USING A LATCH CODE EQUAL TO A 5, A READ ADDRESS AND A READ CODE
. . . .
Applications
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Composite Filter Response Example. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 47. RECEIVE SIGNAL FREQUENCY SPECTRUM
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RF/IF Considerations
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PDC Configuration
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References
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FIGURE 48A. CIC FILTER RESPONSE
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FIGURE 48B. HB3 FILTER RESPONSE
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FIGURE 49A. HB5 FILTER RESPONSE
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FIGURE 49B. 255 FIR TAP FILTER RESPONSE
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FIGURE 49C. COMPOSITE FILTER RESPONSE
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FIGURE 49D. PDC FILTER FREQUENCY SPECTRUMS EXAMPLE (NORMALIZED TO SAME SCALE)
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Configuration Control Word Definitions
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AC Test Load Circuit
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Waveforms
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FIGURE 50. TIMING RELATIVE TO WR
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FIGURE 51. TIMING RELATIVE TO RD
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FIGURE 52. OUTPUT RISE AND FALL TIMES
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FIGURE 53. TIMING RELATIVE TO CLKIN
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 54. OUTPUT ENABLE/DISABLE
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 55. TIMING RELATIVE TO PROCCLK
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
FIGURE 56. REFCLK
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HSP50214B
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