參數(shù)資料
型號(hào): HM66WP18513BP-65
元件分類: SRAM
英文描述: 512K X 18 ZBT SRAM, 6.5 ns, PBGA119
封裝: BGA-119
文件頁(yè)數(shù): 13/31頁(yè)
文件大?。?/td> 268K
代理商: HM66WP18513BP-65
HM66WP18513, HM66WP36257
Rev.0.3, Mar. 2002, page 20 of 31
Write Cycle
CLK
ADV/
tCYC
tCL
tCH
t
Address
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A1
A2
HA
t
SA
t
tSW HW
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1
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t
t SCE HCE
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D
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;;
D (A1)
D (A2)
D (A2+1)
D (A2+2)
D (A3)
D (A2)
D (A3+1)
;;;;;
D (A2+3)
;;;;;
t
tSD HD
Q
tOHZ
Single WRITE
BURST WRITE
;;
;;;;
H or L
Undefined
Notes: 1.
and CE2 have timing identical to
. On this diagram, when
is LOW,
is LOW and CE2 is
HIGH. When
is HIGH,
is HIGH and CE2 is LOW.
2.
must be HIGH before the input data setup and held HIGH throughout the data hold time. This prevents
input/output data contention for the time period prior to the byte write enable inputs being sampled.
3. Full width WRITE can be initiated by
,
to
are LOW.
4. ZZ is LOW.
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A3
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2
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相關(guān)PDF資料
PDF描述
HM6AEB36105BP40 1M X 36 DDR SRAM, 0.45 ns, PBGA165
HM76-408R2J DATA LINE FILTER
HM76-40820J DATA LINE FILTER
HM76-406R8J DATA LINE FILTER
HM76-40681J DATA LINE FILTER
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參數(shù)描述
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