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參數(shù)資料
| 型號： | FW322 |
| 英文描述： | 1394A PCI PHY/Link Open Host Controller Interface |
| 中文描述： | 1394A端口物理層的PCI /鏈接開放主機(jī)控制器接口 |
| 文件頁數(shù)： | 88/148頁 |
| 文件大小： | 1723K |
| 代理商： | FW322 |
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88
Lucent Technologies Inc.
FW322
1394A PCI PHY/Link Open Host Controller Interface
Data Sheet, Rev. 1
February 2001
Internal Registers
(continued)
Interrupt Mask Register
The interrupt mask set/clear register is used to enable the various FW322 interrupt sources. Reads from either the
set register or the clear register always return the contents of the interrupt mask register. In all cases except
masterIntEnable (bit 31), the enables for each interrupt event align with the interrupt event register bits (see
Tables 74 and 75). This register is fully compliant with OHCI, and the FW322 adds an OHCI 1.0 compliant
interrupt function to bit 30.
Table 76. Interrupt Mask Register
Register:
Type:
Offset:
Interupt mask register
Read/Set/Clear/Update
88h
set register
8Ch
clear register
XXXX 0XXXh
Default:
Bit
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Field Name
masterIntEnable
vendorSpecific
Reserved
Type
R
RSC
R
R
R
RSCU
RSCU
RSCU
RSCU
RSCU
RSCU
RSCU
RSCU
R
RSCU
RSCU
R
R
R
R
R
R
RSCU
RSCU
RU
RU
RSCU
RSCU
RSCU
RSCU
RSCU
RSCU
Default
0
X
0
0
0
X
X
X
X
X
X
X
X
0
X
X
0
0
0
0
0
0
X
X
X
X
X
X
X
X
X
X
phyRegRcvd
cycleToolLong
unrecoverableError
cycleInconsistent
cycleLost
cycle64Seconds
cycleSynch
PHY core
Reserved
busReset
selfIDcomplete
Reserved
lockRespErr
postedWriteErr
isochRx
isochTx
RSPkt
RQPkt
ARRS
ARRQ
respTxComplete
reqTxComplete
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