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參數(shù)資料
| 型號： | EPF10K200S |
| 英文描述： | Programmable Logic |
| 中文描述： | 可編程邏輯 |
| 文件頁數(shù)： | 54/138頁 |
| 文件大?。?/td> | 2116K |
| 代理商： | EPF10K200S |
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22
Altera Corporation
FLEX 10K Embedded Programmable Logic Family Data Sheet
In addition to the six clear and preset modes, FLEX 10K devices provide a
chip-wide reset pin that can reset all registers in the device. Use of this
feature is set during design entry. In any of the clear and preset modes, the
chip-wide reset overrides all other signals. Registers with asynchronous
presets may be preset when the chip-wide reset is asserted. Inversion can
be used to implement the asynchronous preset. Figure 10 shows examples
of how to enter a section of a design for the desired functionality.
Figure 10. LE Clear & Preset Modes
Asynchronous Clear
Asynchronous Preset
Asynchronous Clear & Preset
Asynchronous Load without Clear or Preset
PRN
CLRN
D
Q
NOT
Asynchronous Load with Clear
PRN
CLRN
D
Q
NOT
Asynchronous Load with Preset
NOT
PRN
CLRN
D
Q
PRN
CLRN
D
Q
VCC
Chip-Wide Reset
PRN
CLRN
D
Q
PRN
CLRN
D
Q
VCC
Chip-WideReset
Chip-Wide Reset
labctrl1 or
labctrl2
labctrl1 or
labctrl2
labctrl1
(Asynchronous
Load)
labctrl1
(Asynchronous
Load)
labctrl1
(Asynchronous
Load)
data3
(Data)
labctrl2
(Clear)
labctrl2
(Preset)
data3
(Data)
data3
(Data)
labctrl2
labctrl1
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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