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參數(shù)資料
| 型號： | DS3184 |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 77/400頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC QUAD ATM/PACKET PHY 400-PBGA |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 1 |
| 類型： | 調(diào)幀器 |
| 應用： | 數(shù)據(jù)傳輸 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 400-BBGA |
| 供應商設備封裝： | 400-PBGA（27x27） |
| 包裝： | 管件 |
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DS3181/DS3182/DS3183/DS3184
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AIS signal is absent, and it is reset when an AIS signal is absent for 10 to 17 consecutive DS3 frames. An AIS
condition is terminated when an AIS signal is absent for 10 to 17 consecutive DS3 frames.
A Receive Unframed All 1’s (RUA1) condition is declared if in each of 4 consecutive 2047 bit windows, five or less
zeros are detected and an OOF condition is continuously present. A RUA1 condition is terminated if in each of 4
consecutive 2047-bit windows, six or more zeros are detected or an OOF condition is continuously absent.
An Idle Signal (Idle) is a DS3 signal with valid F-bits, M-bits, and P-bits (P1 and P2). The X-bits (X1 and X2) are set
to one, C31, C32, and C33 are set to zero, and the payload bits are set to a 1100 pattern starting with 11 immediately
after each overhead bit. In C-bit mode, an Idle signal is present when a DS3 frame is received with valid F-bits, M-
bits, and P-bits, both X-bits set to one, C31, C32, and C33 set to zero, and all but seven or fewer payload data bits
matching the overhead aligned 1100 pattern. In M23 mode, an Idle signal is present when a DS3 frame is received
with valid F-bits, M-bits, and P-bits, both X-bits set to one, and all but seven or fewer payload data bits matching
the T3 overhead aligned 1100 pattern. An Idle signal is absent when a DS3 frame is received that does not meet
aforementioned criteria for an Idle signal being present. The Idle integration counter declares an Idle condition
when it has been active for a total of 10 to 17 DS3 frames. The Idle integration counter is active (increments count)
when an Idle signal is present, it is inactive (holds count) when an Idle signal is absent, and it is reset when an Idle
signal is absent for 10 to 17 consecutive DS3 frames. An Idle condition is terminated when an Idle signal is absent
for 10 to 17 consecutive DS3 frames.
A Remote Defect Indication (RDI) condition (also called a far-end SEF/AIS defect condition) is declared when four
consecutive DS3 frames are received with the X-bits (X1 and X2) set to zero. An RDI condition is terminated when
four consecutive DS3 frames are received with the X-bits set to one.
A DS3 Framing Format Mismatch (DS3FM) condition is declared when the DS3 format programmed (M23, C-bit)
does not match the incoming DS3 signal-framing format. A DS3FM condition is terminated when the incoming DS3
signal-framing format is the same format as programmed. Framing errors are determined by comparing F-bits and
M-bits to their expected values. The type of framing errors accumulated is programmable (OOF, F & M, F, or M).
An OOF error increments the count whenever OOF condition is first detected. An F & M error increments the count
once for each F-bit or M-bit that does not match its expected value (up to 31 per DS3 frame). An F error increments
the count once for each F-bit that does not match its expected value (up to 28 per DS3 frame). An M error
increments the count once for each M-bit that does not match its expected value (up to 3 per DS3 frame).
P-bit parity errors are determined by calculating the parity of the current DS3 frame (payload bits only), and
comparing the calculated parity to the P-bits (P1 and P2) in the next DS3 frame. If the calculated parity does not
match P1 or P2, a single P-bit parity error is declared.
C-bit parity errors (C-bit format only) are determined by calculating the parity of the current DS3 frame (payload bits
only), and comparing the calculated parity to the C-bits in sub-frame three (C31, C32, and C33) in the next DS3
frame. If the calculated parity does not match C31, C32, or C33, a single C-bit parity error is declared.
FEBE errors (C-bit format only) are determined by the C-bits in sub-frame four (C41, C42, and C43). A value of 111
indicates no error and any other value indicates an error.
10.10.5 C-bit DS3 Framer/Formatter
10.10.5.1 Transmit C-bit DS3 Frame Processor
The C-bit DS3 frame format is shown in Figure 10-40. Table 10-34 shows the function of each overhead bit in the
DS3 Frame
相關PDF資料 |
PDF描述 |
|---|---|
| 24LC32AT-I/MC | IC EEPROM 32KBIT 400KHZ 8DFN |
| HSC49DRTI-S93 | CONN EDGECARD 98POS DIP .100 SLD |
| HSC49DREI-S93 | CONN EDGECARD 98POS .100 EYELET |
| 93AA56C-I/SN | IC EEPROM 2KBIT 3MHZ 8SOIC |
| 93C46C-I/SN | IC EEPROM 1KBIT 3MHZ 8SOIC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| DS3184+ | 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3184DK | 功能描述:網(wǎng)絡開發(fā)工具 RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V |
| DS3184N | 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3184N+ | 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS318PIN | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Industrial Control IC |
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