參數(shù)資料
型號： DS3184
廠商： Maxim Integrated Products
文件頁數(shù)： 144/400頁
文件大?。?/td> 0K
描述： IC QUAD ATM/PACKET PHY 400-PBGA
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 1
類型： 調幀器
應用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應商設備封裝： 400-PBGA（27x27）
包裝： 管件
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DS3181/DS3182/DS3183/DS3184
228
Bit 2: Transmit System Fill Level Inversion (TFLVI) – When 0, the polarity of the TPXA, TDXA, and TSPA
signals will be normal (high for data available). When 1, the polarity of the TPXA, TDXA, and TSPA signals will be
inverted (low for data available).
Bit 1: Transmit System Interface Byte Reordering Enable (TSBRE) – When 0, byte reordering is disabled, and
the first byte transmitted is transferred across the system interface as the most significant byte (TDATA[31:24] in
32-bit mode or TDATA[15:8] in 16-bit mode). When 1, byte reordering is enabled, and the first byte transmitted is
transferred across the system interface as the least significant byte (TDATA[7:0]).
Bit 0: Transmit System HEC Transfer (THECT) – When 0, The HEC byte is not transferred across the transmit
system interface. When 1, the HEC byte is transferred across the transmit system interface with the cell data.
Register Name:
SI.TSRL
Register Description:
System Interface Transmit Status Register Latched
Register Address:
032h
Bit #
15
14
13
12
11
10
9
8
Name
—
Bit #
7
6
5
4
3
2
1
0
Name
—
TSCLKAL
TPREL
Bit 1: Transmit System Interface Clock Active (TSCLKAL) – This bit is set when TSCLK is active.
Bit 0: Transmit System Interface Parity Error Latched (TPREL) – This bit is set when a parity error is detected
during a data transfer on the Transmit System Interface bus.
Register Name:
SI.TSRIE
Register Description:
System Interface Transmit Status Register Interrupt Enable
Register Address:
034h
Bit #
15
14
13
12
11
10
9
8
Name
—
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
—
TPREIE
Default
0
Bit 0: Transmit System Interface Parity Error Interrupt Enable (TPREIE) – This bit enables an interrupt if the
TPREL bit in the TSISRL register is set and the bit in GL.ISRIE.PSRIE[4:1] that corresponds to this port is set.
0 = interrupt disabled
1 = interrupt enabled
相關PDF資料
PDF描述
24LC32AT-I/MC IC EEPROM 32KBIT 400KHZ 8DFN
HSC49DRTI-S93 CONN EDGECARD 98POS DIP .100 SLD
HSC49DREI-S93 CONN EDGECARD 98POS .100 EYELET
93AA56C-I/SN IC EEPROM 2KBIT 3MHZ 8SOIC
93C46C-I/SN IC EEPROM 1KBIT 3MHZ 8SOIC
相關代理商/技術參數(shù)
參數(shù)描述
DS3184+ 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184DK 功能描述:網(wǎng)絡開發(fā)工具 RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS3184N 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184N+ 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS318PIN 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Industrial Control IC
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