FF.RCR.RFRST = 1. Clear the FIFO Reset bits. FF.TCR.TFRST = 0. FF.RCR.RFRST = 0. Set the FIFO Tran" />
參數(shù)資料
型號： DS3184
廠商： Maxim Integrated Products
文件頁數(shù)： 394/400頁
文件大?。?/td> 0K
描述： IC QUAD ATM/PACKET PHY 400-PBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1
類型： 調(diào)幀器
應(yīng)用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 管件
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DS3181/DS3182/DS3183/DS3184
93
FF.RCR.RFRST = 1.
Clear the FIFO Reset bits.
FF.TCR.TFRST = 0.
FF.RCR.RFRST = 0.
Set the FIFO Transmit Level Control Register and the FIFO Transmit Port Address Control Register.
Set the FIFO Receive Level Control Register and the FIFO Receive Port Address Control Register.
The Port Address needs to be configured to match the master controller address for each port.
STEP 10: Configure the System Bus
Configure for bus size and for interface type. See Table 9-1.
Optionally, set the System Interface Transmit Control Register, System Interface Receive Control Register
#1 and #2 to fine tune for the specific application.
(User may leave registers at default value.)
STEP 11: Configure the Cell or Packet Processor
For cell mode, the default is to send the cell across the system interface without the HEC. Also, default
mode scrambles the cell data to the line.
To attach the HEC to the cell, set SI.TCR.THECT = 1 and SI.RCR.RHECT = 1.
STEP 12: Enable each port (for non-LIU modes)
PORT.CR2.TLEN = 1
Table 9-1. Configuration of Global Register Settings
Note: This table assumes a DS3 clock input on the CLKA pin.
MODE
0x002
4
0x00A
UTOPIA L2
0000 XX00 0000 0000
0x0204
0x0000
UTOPIA L3
0000 XX01 0000 0000
0x0204
0x0000
POS-PHY L2
0000 XX10 0000 0000
0x0204
0x0000
POS-PHY L3 or SPI-3
0000 XX11 0000 0000
0x0204
0x0000
8-Bit System Bus
0000 00XX 0000 0000
0x0204
0x0000
16-Bit System Bus
0000 01XX 0000 0000
0x0204
0x0000
32-Bit System Bus
0000 10XX 0000 0000
0x0204
0x0000
Table 9-2. Configuration of Port Register Settings
Note: The Line Mode has been configured with the LIU enabled and the JA in the receive path (LM[2:0] = 011) for all modes except OHM mode.
Only Port 1 registers have been displayed.
MODE
0x040
0x042
0x044
0x046
DS3 C-Bit
0x7C00
0000 0011 0000 000X
0x0000
DS3 C-Bit PLCP
0x7C00
0000 0011 0000 010X
0x0000
DS3 M23
0x7C00
0000 0011 0000 100X
0x0000
DS3 M23 PLCP
0x7C00
0000 0011 0000 110X
0x0000
E3.751
0x7C00
0000 0011 0001 000X
0x0000
E3.751 PLCP
0x7C00
0000 0011 0001 010X
0x0000
E3.823
0x7C00
0000 0011 0001 100X
0x0000
OHM Mode (DS3/E3/Clear
Channel)
0x7C00
1100 0XXX 00XX XXXX
0x0000
相關(guān)PDF資料
PDF描述
24LC32AT-I/MC IC EEPROM 32KBIT 400KHZ 8DFN
HSC49DRTI-S93 CONN EDGECARD 98POS DIP .100 SLD
HSC49DREI-S93 CONN EDGECARD 98POS .100 EYELET
93AA56C-I/SN IC EEPROM 2KBIT 3MHZ 8SOIC
93C46C-I/SN IC EEPROM 1KBIT 3MHZ 8SOIC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
DS3184+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184DK 功能描述:網(wǎng)絡(luò)開發(fā)工具 RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS3184N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184N+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS318PIN 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Industrial Control IC
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