(VDD
參數(shù)資料
型號(hào)： DS3112N+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 18/133頁(yè)
文件大?。?/td> 0K
描述： IC MUX TEMPE T3/E3 256-BGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 40
控制器類型： 調(diào)幀器，多路復(fù)用器
接口： 并行/串行
電源電壓： 3.135 V ~ 3.465 V
電流 - 電源： 150mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-PBGA（27x27）
包裝： 管件
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)當(dāng)前第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)
DS3112
114 of 133
Table 13-4. AC Characteristics—CPU Bus (Multiplexed and Nonmultiplexed)
(VDD = 3.3V ±5%, TA = 0°C to +70°C for DS3112; TA = -40°C to +85°C for DS3112N.)
(See
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
Setup Time for CA[7:0] Valid to
CCS
Active
t1
0
ns
Setup Time for
CCS Active to CRD,
CWR, or CDS Active
t2
0
ns
Delay Time from
CRD or CDS Active
to CD[15:0] Valid
t3
65
ns
Hold Time from
CRD or CWR or CDS
Inactive to
CCS Inactive
t4
0
ns
Hold Time from
CCS or CRD or CDS
Inactive to CD[15:0] Tri-State
t5
5
20
ns
Wait Time from
CWR or CDS Active
to Latch CD[15:0]
t6
65
ns
CD[15:0] Setup Time to
CWR or CDS
Inactive
t7
10
ns
CD[15:0] Hold Time from
CWR or
CDS Inactive
t8
2
ns
CA[7:0] Hold Time from
CWR or
CRD or CDS Inactive
t9
5
ns
CRD, CWR, or CDS Inactive Time
t10
75
ns
Muxed Address Valid to CALE Falling
t11
10
ns
2
Muxed Address Hold Time
t12
10
ns
2
CALE Pulse Width
t13
30
ns
2
Setup Time for CALE High or Muxed
Address Valid to
CCS Active
t14
0
ns
2
NOTES:
1)
In nonmultiplexed bus applications (
), CALE should be tied high.
2)
In multiplexed bus applications (
), CA[7:0] should be tied to CD[7:0] and the falling edge of CALE
will latch the address.
相關(guān)PDF資料
PDF描述
DS3112 IC MUX TEMPE T3/E3 256-BGA
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參數(shù)描述
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