參數(shù)資料
型號(hào)： DS26504L+
廠商： Maxim Integrated Products
文件頁數(shù)： 20/129頁
文件大?。?/td> 0K
描述： IC T1/E1/J1 64KCC ELEMENT 64LQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1
功能： BITS 元件
接口： 64KCC，E1，T1
電路數(shù)： 1
電源電壓： 3.14 V ~ 3.47 V
電流 - 電源： 150mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-LQFP（10x10）
包裝： 托盤
包括： *
產(chǎn)品目錄頁面： 1430 (CN2011-ZH PDF)
DS26504 T1/E1/J1/64KCC BITS Element
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20. AC TIMING PARAMETERS AND DIAGRAMS
Capacitive test loads are 40pF for bus signals and 20pF for all others.
20.1 Multiplexed Bus
Table 20-1. AC Characteristics, Multiplexed Parallel Port
(VDD = 3.3V ±5%, TA = 0°C to +70°C for DS26504L; VDD = 3.3V ±5%, TA = -40°C to +85°C for
DS26504LN.) (Note 1) (Figure 20-1, Figure 20-2, and Figure 20-3)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
Cycle Time
tCYC
200
ns
Pulse Width,
DS Low or RD High
PWEL
100
ns
Pulse Width,
DS High or RD Low
PWEH
100
ns
Input Rise/Fall Times
tR, tF
20
ns
R/
W Hold Time
tRWH
10
ns
R/
W Setup Time Before DS High
tRWS
50
ns
CS Setup Time Before DS, WR, or
RD Active
tCS
20
ns
CS Hold Time
tCH
0
ns
Read Data Hold Time
tDHR
10
50
ns
Write Data Hold Time
tDHW
5
ns
Muxed Address Valid to AS or
ALE Fall
tASL
15
ns
Muxed Address Hold Time
tAHL
10
ns
Delay Time
DS, WR, or RD to AS
or ALE Rise
tASD
20
ns
Pulse Width AS or ALE High
PWASH
30
ns
Delay Time, AS or ALE to
DS,
WR, or RD
tASED
10
ns
Output Data Delay Time from
DS
or
RD
tDDR
80
ns
Data Setup Time
tDSW
50
ns
Note 1:
The timing parameters in this table are guaranteed by design (GBD).
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PDF描述
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