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參數(shù)資料
| 型號： | DS2180A |
| 廠商： | DALLAS SEMICONDUCTOR |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | T1 Transceiver(T1收發(fā)器) |
| 中文描述： | DATACOM, FRAMER, PDIP40 |
| 封裝： | 0.600 INCH, DIP-40 |
| 文件頁數(shù)： | 24/35頁 |
| 文件大?。?/td> | 232K |
| 代理商： | DS2180A |
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DS2180A
022798 24/35
193E FRAMING FORMAT
Table 7
FRAME
NUMBER
F-BIT USE
BIT USE IN EACH CHANNEL
SIGNALING-BIT USE
FPS
1
FDL
2
CRC
3
DATA
SIGNALING
2
STATE
4
STATE
16
STATE
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
–
–
–
0
–
–
–
0
–
–
–
1
–
–
–
0
–
–
–
1
–
–
–
1
M
–
M
–
M
–
M
–
M
–
M
–
M
–
M
–
M
–
M
–
M
–
M
–
–
C1
–
–
–
C2
–
–
–
C3
–
–
–
C4
–
–
–
C5
–
–
–
C6
–
–
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–7
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–7
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–7
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–8
BITS 1–7
BIT 8
BIT 8
BIT 8
BIT 8
A
A
A
A
A
B
A
B
A
B
C
D
NOTES:
1. FPS – Framing Pattern Sequence.
2. FDL – 4 KHz Facility Data Link; M = message bits.
3. CRC – Cyclic Redundancy Check bits. The CRC code will be internally generated by the device when
TCR.5=0. When TCR.5=1, externally supplied CRC data will be sampled at TSER during the F-bit time of
frames 2, 6, 10, 14, 18, 22.
4. The user may program any individual channels clear, in which case bit 8 will be used for data, not signaling.
5. Depending on application, the user can support 2-state, 4-state or 16-state signaling by the appropriate de-
codes of TMO, TSIGFR, TSIGSEL (Transmit Side) and RMSYNC, RSIGFR and RSIGSEL (Receive Side).
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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