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參數資料
| 型號： | DS21554LN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數： | 100/124頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TXRX E1 1-CHIP 5V 100-LQFP |
| 產品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 90 |
| 功能： | 單芯片收發(fā)器 |
| 接口： | E1，HDLC，J1，T1 |
| 電路數： | 1 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 電流 - 電源： | 75mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應商設備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
| 包括： | 遠程和 AIS 警報檢測器 / 發(fā)生器 |
| 產品目錄頁面： | 1430 (CN2011-ZH PDF) |
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DS21354/DS21554 3.3V/5V E1 Single-Chip Transceivers
77 of 124
THIR: TRANSMIT HDLC INFORMATION REGISTER (Address = B6 Hex)
(MSB)
(LSB)
—
TEMPTY
TFULL
TUDR
SYMBOL
POSITION
NAME AND DESCRIPTION
—
THIR.7
Not Assigned. Could be any value when read.
—
THIR.6
Not Assigned. Could be any value when read.
—
THIR.5
Not Assigned. Could be any value when read.
—
THIR.4
Not Assigned. Could be any value when read.
—
THIR.3
Not Assigned. Could be any value when read.
TEMPTY
THIR.2
Transmit FIFO Empty. A real-time bit that is set high when the FIFO is
empty.
TFULL
THIR.1
Transmit FIFO Full. A real-time bit that is set high when the FIFO is
full.
TUDR
THIR.0
Transmit FIFO Underrun. Set when the transmit FIFO empties out
without the TEOM control bit being set. An abort is automatically sent.
Note: The TUDR bit is latched and is cleared when read.
THFR: TRANSMIT HDLC FIFO REGISTER (Address = B7 Hex)
(MSB)
(LSB)
HDLC7
HDLC6
HDLC5
HDLC4
HDLC3
HDLC2
HDLC1
HDLC0
SYMBOL
POSITION
NAME AND DESCRIPTION
HDLC7
THFR.7
HDLC Data Bit 7. MSB of a HDLC packet data byte.
HDLC6
THFR.6
HDLC Data Bit 6.
HDLC5
THFR.5
HDLC Data Bit 5.
HDLC4
THFR.4
HDLC Data Bit 4.
HDLC3
THFR.3
HDLC Data Bit 3.
HDLC2
THFR.2
HDLC Data Bit 2.
HDLC1
THFR.1
HDLC Data Bit 1.
HDLC0
THFR.0
HDLC Data Bit 0. LSB of a HDLC packet data byte.
相關PDF資料 |
PDF描述 |
|---|---|
| DS21352LN+ | IC TXRX T1 1-CHIP 3.3V 100-LQFP |
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相關代理商/技術參數 |
參數描述 |
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