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參數(shù)資料
| 型號： | CY505YC64DT |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 9/24頁 |
| 文件大小： | 0K |
| 描述： | IC CLK CK505 BROADWATER 64TSSOP |
| 標準包裝： | 28 |
| 類型： | 時鐘/頻率發(fā)生器 |
| PLL： | 是 |
| 主要目的： | Intel CPU 服務(wù)器 |
| 輸入： | 晶體 |
| 輸出： | HCSL，LVCMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:24 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 400.9MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-TFSOP （0.240"，6.10mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 64-TSSOP |
| 包裝： | 管件 |
CY505YC64D
....................Document #: 001-03543 Rev *E Page 17 of 24
Figure 8. Clock Generator Power-up/Run State Diagram
M1
iAMT Mode
Power Down
CPU STOP
CPU & PCI STOP
PCI STOP
Latches
Open
Clock OFF
1100XX 1101XX
1110XX 1100XX
1101XX
1110XX
1111XX
1101XX
11XX01
10XX01
1111XX
1100XX
1111XX
1110XX
10XX00
11XX1X
10XX1X
See Clock Off
to M 1 transition
for details
0XXXXX
1000XX
11XX0X
iAM T_EN Bit=0
via CK505
BSEL's loaded serially
M0
Norm al
Operation
0XXXXX
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
CKPW RGD/
PW RDW N
CPU_STOP#
PCI_STOP#
iAMT_EN
PD_RESTORE
Bit 4
VDD_MAIN
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CYW150OXC | IC CLOCK 440BX AGP 56SSOP |
| CYW173SXC | IC CLK GEN TAPE DRV 4CH 16SOIC |
| CYW305OXC | IC CLOCK W305 SOLANO 56SSOP |
| DAC5674IPHPG4 | IC DAC 14BIT 400MSPS 48-HTQFP |
| DAC7621EBG4 | IC SNGL 12BIT PARALLEL D/A 20SSO |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY505YC64DTT | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 CK505 Lakeport Bearlake RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| CY50C475Z | 制造商:PHILIPS 功能描述:Miniature Monolithic Epoxy Coated Ceramic Radial Leads Capacitor - 4.7uF 50dcV +80-20% |
| CY512 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Stepper System Controller |
| CY512P | 制造商:CYLINK 功能描述:512P |
| CY525 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Stepper System Controller |
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