參數(shù)資料
型號： AS7C31026B-20BIN
廠商： ALLIANCE MEMORY INC
元件分類： SRAM
英文描述： 64K X 16 STANDARD SRAM, 20 ns, PBGA48
封裝： 6 X 8 MM, LEAD FREE, BGA-48
文件頁數(shù)： 6/11頁
文件大?。?/td> 293K
代理商： AS7C31026B-20BIN
AS7C31026B
2/27/04, v 1.2
Alliance Semiconductor
P. 4 of 11
Key to switching waveforms
Read waveform 1 (address controlled)3,6,7,9
Read cycle (over the operating range)3,9
Parameter
Symbol
-10
-12
-15
-20
Unit Notes
Min
Max
Min
Max
Min
Max
Min
Max
Read cycle time
tRC
10–12–15–20–
ns
Address access time
tAA
–10–12
–
15–20
ns3
Chip enable (CE) access time
tACE
–10–12
–
15–20
ns3
Output enable (OE) access time
tOE
–
5–6–
7–8
ns
Output hold from address change
tOH
3
–3–3
–3–
ns
5
CE low to output in low Z
tCLZ
3
–3–3
–3–
ns
4, 5
CE high to output in high Z
tCHZ
–
3–3–
4–5
ns
4, 5
OE low to output in low Z
tOLZ
0
–0–0
–0–
ns
4, 5
Byte select access time
tBA
–
5–6–
7–8
ns
Byte select Low to low Z
tBLZ
0
–0–0
–0–
ns
4, 5
Byte select High to high Z
tBHZ
–
5–6–
6–8
ns
4, 5
OE high to output in high Z
tOHZ
–
5–6–
7–8
ns
4, 5
Power up time
tPU
0
–0–0
–0–
ns
4, 5
Power down time
tPD
–
10
–
12
–
15
20
ns
4, 5
Undefined output/don’t care
Falling input
Rising input
tOH
tAA
tRC
tOH
DataOUT
Address
Data valid
Previous data valid
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PDF描述
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