參數(shù)資料
型號： ADUC7036CCPZ-RL
廠商： Analog Devices Inc
文件頁數(shù)： 113/132頁
文件大小： 0K
描述： IC MCU 96K FLASH DUAL 48LFCSP
標準包裝： 2,500
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 20.48MHz
連通性： LIN，SPI，UART/USART
外圍設備： PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 9
程序存儲器容量： 96KB（48K x 16）
程序存儲器類型： 閃存
RAM 容量： 1.5K x 32
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 18 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x16b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 115°C
封裝/外殼： 48-VFQFN 裸露焊盤，CSP
包裝： 帶卷 (TR)
ADuC7036
Rev. C | Page 81 of 132
Timer 3 Control Register
Name: T3CON
Address: 0xFFFF0368
Default Value: 0x0000
Access: Read/write
Function: The 16-bit MMR configures the Timer3 mode of operation as described in Table 56.
Table 56. T3CON MMR Bit Designations
Bit
Description
15 to 9
Reserved. These bits are reserved and should be written as 0 by user code.
8
Count up/count down enable.
Set by user code to configure Timer3 to count up.
Cleared by user code to configure Timer3 to count down.
7
Timer3 enable.
Set by user code to enable Timer3.
Cleared by user code to disable Timer3.
6
Timer3 operating mode.
Set by user code to configure Timer3 to operate in periodic mode.
Cleared by user code to configure Timer3 to operate in free running mode.
5
Watchdog timer mode enable.
Set by user code to enable watchdog mode.
Cleared by user code to disable watchdog mode.
4
Reserved. This bit is reserved and should be written as 0 by user code.
3 to 2
Timer3 clock (32.768 kHz) prescaler.
00 = source clock/1 (default).
01 = source clock/16.
10 = source clock/256.
11 = reserved.
1
Watchdog timer IRQ enable.
Set by user code to produce an IRQ instead of a reset when the watchdog reaches 0.
Cleared by user code to disable the IRQ option.
0
PD_OFF.
Set by user code to stop Timer3 when the peripherals are powered down using Bit 4 in the POWCON MMR.
Cleared by user code to enable Timer3 when the peripherals are powered down using Bit 4 in the POWCON MMR.
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PDF描述
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參數(shù)描述
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