Flags For Flags, see Table 9 and Figure 12. Table 9. Flags Parameter Min Max Unit Timing Requirements
參數(shù)資料
型號： ADSP-21160NCBZ-100
廠商： Analog Devices Inc
文件頁數(shù)： 13/48頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 32BIT 400-PBGA
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點
接口： 主機(jī)接口，連接端口，串行端口
時鐘速率： 100MHz
非易失內(nèi)存： 外部
芯片上RAM： 512kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.90V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 托盤
ADSP-21160N
–20–
REV. 0
Flags
For Flags, see Table 9 and Figure 12.
Table 9. Flags
Parameter
Min
Max
Unit
Timing Requirements
tSFI
FLAG3–0 IN Setup Before CLKIN High
1
4ns
tHFI
FLAG3–0 IN Hold After CLKIN High
1ns
tDWRFI
FLAG3–0 IN Delay After
RDx/WRx Low1
10
ns
tHFIWR
FLAG3–0 IN Hold After
RDx/WRx Deasserted1
0ns
Switching Characteristics
tDFO
FLAG3–0 OUT Delay After CLKIN High
9
ns
tHFO
FLAG3–0 OUT Hold After CLKIN High
1
ns
tDFOE
CLKIN High to FLAG3–0 OUT Enable
1
ns
tDFOD
CLKIN High to FLAG3–0 OUT Disable
tCK–tCCLK+5
ns
1 Flag inputs meeting these setup and hold times for instruction cycle N will affect conditional instructions in instruction cycle N+2.
Figure 12. Flags
CLKIN
FLAG3–0 OUT
FLAG OUTPUT
CLKIN
RDx
FLAG INPUT
FLAG3–0 IN
tDFO
tHFO
tDFO
tDFOD
tDFOE
tSFI
tHFI
tHFIWR
tDWRFI
WRx
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PDF描述
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