參數(shù)資料
型號(hào)： ADP5042ACPZ-2-R7
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 3/32頁(yè)
文件大小： 1378K
描述： IC REG TRPL BCK/LINEAR 20LFCSP
標(biāo)準(zhǔn)包裝： 1
拓?fù)洌?/td> 降壓（降壓）同步（1），線性（LDO）（2）
功能： 任何功能
輸出數(shù)： 3
頻率 - 開關(guān)： 3MHz
電壓/電流 - 輸出 1： 1.5V，800mA
電壓/電流 - 輸出 2： 1.8V，300mA
電壓/電流 - 輸出 3： 3.3V，300mA
帶 LED 驅(qū)動(dòng)器： 無
帶監(jiān)控器： 是
帶序列發(fā)生器： 是
電源電壓： 1.7 V ~ 5.5 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 20-WFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 20-LFCSP-WQ（4x4）
包裝： 標(biāo)準(zhǔn)包裝
其它名稱： ADP5042ACPZ-2-R7DKR
Data Sheet
ADP5042
 
Rev. A | Page 3 of 32
SPECIFICATIONS
GENERAL SPECIFICATION
AVIN, VIN1 = (VOUT1+ 0.5 V) or 2.3 V, whichever is greater, AVIN, VIN1 e VIN2, VIN3, TA = 25癈, unless otherwise noted. Regulators
are enabled.
Table 1.
Parameter
Symbol
Description
Min    Typ    Max    Unit
AVIN UNDERVOLTAGE LOCKOUT
UVLOAVIN
TJ = 40癈 to +125癈
 
 
 
 
Input Voltage Rising
UVLOAVINRISE     
 
 
2.25    V
Input Voltage Falling
UVLOAVINFALL     
1.95    
 
V
SHUTDOWN CURRENT
IGND-SD
ENx = GND
 
0.1
 
礎(chǔ)
 
 
ENx = GND, TJ = 40癈 to +125癈
 
 
2
礎(chǔ)
Thermal Shutdown Threshold
TSSD
TJ rising
 
150     
癈
Thermal Shutdown Hysteresis
TS
SD-HYS
 
 
 
20
 
癈
ENx, WDIx, MODE, WMOD, MR
 INPUTS     
 
 
 
 
 
Input Logic High
VIH
2.5 V d AVIN d 5.5 V
1.2
 
 
V
Input Logic Low
VIL
2.5 V d AVIN d 5.5 V
 
 
0.4
V
Input Leakage Current (WMOD
Excluded)
VI-LEAKAGE
ENx = AVIN or GND
 
0.05    
礎(chǔ)
 
 
ENx = AVIN or GND, T
J
 = 40癈 to +125癈
 
 
1
礎(chǔ)
WMOD Input Leakage Current
V
I-LKG-WMOD
 
VWMOD = 3.6 V, T
J
 = 40癈 to +125癈
 
 
50
礎(chǔ)
OPEN-DRAIN OUTPUTS
 
 
 
 
 
 
nRSTO, WSTAT Output Voltage
V
OL
 
AVIN = 2.3 V to 5.5 V, I
nRSTO/WSTAT
 = 3 mA
 
30
 
mV
Open-Drain Reset Output Leakage
Current
 
 
 
 
1
礎(chǔ)
 
SUPERVISORY SPECIFICATION
AVIN, VIN1 = full operating range, T
J
 = 40癈 to +125癈, unless otherwise noted.
Table 2.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
SUPPLY
 
 
 
 
 
Supply Current (Supervisory Circuit Only)
 
45
55
礎(chǔ)
AVIN = 5.5 V, EN1 = EN2 = EN3 = VIN
 
 
43
52
礎(chǔ)
AVIN = 3.6 V, EN1 = EN2 = EN3 = VIN
RESET THRESHOLD ACCURACY
VTH  0.8%
VTH
VTH + 0.8%    V
TA = 25癈, sensed on VOUTx
 
VTH  1.5%
VTH
VTH + 1.5%    V
T
J
 = 40癈 to +125癈, sensed on
V
OUTx
 
RESET THRESHOLD TO OUTPUT DELAY
GLITCH IMMUNITY (t
UOD
)
50
125
400
祍
VTH = VUOT  50 mV
RESET TIMEOUT PERIOD WATCHDOG1 (tRP1)
 
 
 
 
 
Option A
24
30
36
ms
 
Option B
160
200
240
ms
 
RESET TIMEOUT PERIOD WATCHDOG2 (tRP2)
 
 
 
 
 
 
3.5
5
7
ms
 
VCC TO RESET DELAY (tRD)
 
150
 
祍
VIN1 falling at 1 mV/祍
REGULATORS SEQUENCING DELAY (t
D1
, t
D2
)
 
2
 
ms
 
WATCHDOG INPUTS
 
 
 
 
 
Watchdog 1 Timeout Period (t
WD1
)
 
 
 
 
 
Option A
81.6
102
122.4
ms
 
Option B
1.28
1.6
1.92
sec
 
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PDF描述
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ADP50450003CBZR 制造商:Analog Devices 功能描述:
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