VEE 2 CLK " />
參數(shù)資料
型號(hào)： ADCLK946/PCBZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 9/12頁(yè)
文件大?。?/td> 0K
描述： KIT EVAL CLK BUFF ADCLK946
設(shè)計(jì)資源： ADCLK946 Schematic
ADCLK946 Gerber File
ADCLK946 BOM
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘緩沖器 / 驅(qū)動(dòng)器 / 接收器 / 變換器
嵌入式： 否
已用 IC / 零件： ADCLK946
主要屬性： 1 輸入，6 輸出
次要屬性： LVPECL 輸出邏輯
已供物品： 板
ADCLK946
Rev. A | Page 6 of 12
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
PIN 1
INDICATOR
1
VEE
2
CLK
3
CLK
4
VREF
5
VT
6
VEE
15 Q3
16 Q2
17 Q2
18 VCC
14 Q3
13 VCC
7
V
EE
8
Q5
9
Q5
11
Q4
12
V
EE
10
Q4
21
Q1
22
Q0
23
Q0
24
V
CC
20
Q1
19
V
EE
ADCLK946
TOP VIEW
(Not to Scale)
NOTES:
1. EXPOSED PADDLE MUST BE CONNECTED TO VEE.
08053-
002
Figure 2. Pin Configuration
Table 6. Pin Function Descriptions
Pin No.
Mnemonic
Description
1, 6, 7, 12, 19
VEE
Negative Supply Pin.
2
CLK
Differential Input (Positive).
3
CLK
Differential Input (Negative).
4
VREF
Reference Voltage. This pin provides the reference voltage for biasing ac-coupled CLK and CLK inputs.
5
VT
Center Tap. This pin provides the center tap of a 100 input resistor for CLK and CLK inputs.
8, 9
Q5, Q5
Differential LVPECL Outputs.
10, 11
Q4, Q4
Differential LVPECL Outputs.
13, 18, 24
VCC
Positive Supply Pin.
14, 15
Q3, Q3
Differential LVPECL Outputs.
16, 17
Q2, Q2
Differential LVPECL Outputs.
20, 21
Q1, Q1
Differential LVPECL Outputs.
22, 23
Q0, Q0
Differential LVPECL Outputs.
EPAD
EPAD must be soldered to VEE.
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PDF描述
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ADCLK948BCPZ 制造商:Analog Devices 功能描述:CLOCK FANOUT BUFFER, 4.8GHZ, LFCSP-32
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