參數(shù)資料
型號(hào)： AD9514/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 23/28頁
文件大?。?/td> 0K
描述： BOARD EVAL CLOCK 3CH AD9514
設(shè)計(jì)資源： AD9513/14/15 Eval Brd Schematics
AD9513/14/15 Gerber Files
AD9514 Eval Brd BOM
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘分配
已用 IC / 零件： AD9514
已供物品： 板
相關(guān)產(chǎn)品： AD9514BCPZ-ND - IC CLOCK DIST 3OUT PLL 32LFCSP
AD9514BCPZ-REEL7-ND - IC CLOCK DIST 3OUT PLL 32LFCSP
AD9514
Rev. 0 | Page 4 of 28
TIMING CHARACTERISTICS
CLK input slew rate = 1 V/ns or greater.
Table 3.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVPECL
Termination = 50 Ω to VS 2 V
Output Rise Time, tRP
60
100
ps
20% to 80%, measured differentially
Output Fall Time, tFP
60
100
ps
80% to 20%, measured differentially
PROPAGATION DELAY, tPECL, CLK-TO-LVPECL OUT
Divide = 1
355
480
635
ps
Divide = 2 32
395
530
710
ps
Variation with Temperature
0.5
ps/°C
OUTPUT SKEW, LVPECL
OUT0 to OUT1 on Same Part, tSKP1
50
0
+55
ps
Both LVPECL Outputs Across Multiple Parts, tSKP_AB2
125
ps
Same LVPECL Output Across Multiple Parts, tSKP_AB2
125
ps
LVDS
Termination = 100 Ω differential, 3.5 mA
Output Rise Time, tRL
200
350
ps
20% to 80%, measured differentially
Output Fall Time, tFL
210
350
ps
80% to 20%, measured differentially
PROPAGATION DELAY, tLVDS, CLK-TO-LVDS OUT
Optional delay off
Divide = 1
1.00
1.25
1.55
ns
Divide = 2 32
1.05
1.30
1.60
ns
Variation with Temperature
0.9
ps/°C
OUTPUT SKEW, LVDS
Optional delay off
LVDS Output Across Multiple Parts, tSKV_AB2
230
ps
CMOS
B outputs are inverted; termination = open
Output Rise Time, tRC
650
865
ps
20% to 80%; CLOAD = 3 pF single-ended
Output Fall Time, tFC
650
990
ps
80% to 20%; CLOAD = 3 pF single-ended
PROPAGATION DELAY, tCMOS, CLK-TO-CMOS OUT
Optional delay off
Divide = 1
1.10
1.45
1.75
ns
Divide = 2 32
1.15
1.50
1.80
ns
Variation with Temperature
1
ps/°C
OUTPUT SKEW, CMOS
Optional delay off
CMOS Output Across Multiple Parts, tSKC_AB2
300
ps
LVPECL-TO-LVDS OUT
Output Delay, tSKV_C
560
790
950
ps
LVPECL-TO-CMOS OUT
Output Delay, tSKV_C
700
970
1150
ps
DELAY ADJUST (OUT2; LVDS and CMOS)
S0 = 1/3
Zero Scale Delay Time3
0.34
ns
Zero Scale Variation with Temperature
0.20
ps/°C
Full Scale Time Delay3
1.7
ns
Full Scale Variation with Temperature
0.38
ps/°C
S0 = 2/3
Zero Scale Delay Time3
0.45
ns
Zero Scale Variation with Temperature
0.31
ps/°C
Full Scale Time Delay3
5.9
ns
Full Scale Variation with Temperature
1.3
ps/°C
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