參數(shù)資料
型號(hào)： AD9510BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 44/56頁
文件大?。?/td> 0K
描述： IC CLOCK DIST 8OUT PLL 64LFCSP
標(biāo)準(zhǔn)包裝： 750
類型： 扇出緩沖器（分配），除法器
PLL： 是
輸入： 時(shí)鐘
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:8
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1.2GHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 帶卷 (TR)
配用： AD9510-VCO/PCBZ-ND - BOARD EVALUATION FOR AD9510
AD9510/PCBZ-ND - BOARD EVALUATION FOR AD9510
Data Sheet
AD9510
Rev. B | Page 49 of 56
Reg.
Addr.
(Hex) Bit(s) Name
Description
[2:0] Ramp current
35
OUT5
The slowest ramp (200 A) sets the longest full scale of approximately 10 ns.
39
OUT6
[2]
[1]
[0]
Ramp Current (A)
0
200
0
1
400
0
1
0
600
0
1
800
1
0
1000
1
0
1
1200
1
0
1400
1
1600
[5:3] Ramp capacitor
Selects the number of capacitors in ramp generation circuit.
35
OUT5
More capacitors
→ slower ramp.
39
OUT6
[5]
[4]
[3]
Number of Capacitors
0
4 (default)
0
1
3
0
1
0
3
0
1
2
1
0
3
1
0
1
2
1
0
2
1
[5:1] Delay fine adjust
36
OUT5
Sets delay within full scale of the ramp; there are 25 steps.
3A
OUT6
00000
→ zero delay (default).
11000
→ maximum delay.
3C
[1:0] Power-down
LVPECL
3D
OUT0
3E
OUT1
3F
OUT2
OUT3
Mode
[1]
[0]
Description
Output
On
0
Normal operation.
On
PD1
0
1
Test only—do not use.
Off
PD2
1
0
Safe power-down. Partial power-down; use if output
has load resistors.
Off
PD3
1
Total power-down. Use only if output has no
load resistors.
Off
3C
[3:2] Output level LVPECL
3D
OUT0
Output single-ended voltage levels for LVPECL outputs.
3E
OUT1
3F
OUT2
OUT3
[3]
[2]
Output Voltage (mV)
0
500
0
1
340
1
0
810 (default)
1
660
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PDF描述
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