參數(shù)資料
型號(hào)： AD1895
廠商： Analog Devices, Inc.
英文描述： 3 V/5 V Digital Audio Receiver,External APLL(數(shù)字音頻接收器)
中文描述： 3伏/ 5 V數(shù)字音頻接收器，外部美集（數(shù)字音頻接收器）
文件頁(yè)數(shù)： 2/16頁(yè)
文件大小： 130K
代理商： AD1895
T E ST CONDIT IONS UNLE SS OT HE RWISE NOT E D
Supply Voltage
Ambient T emperature
Sample Frequency (F
S
)
Load Capacitance
+3.0
25
44.1
100
V
°
C
kHz
pF
All minimums and maximums tested except as noted.
PE RFORMANCE
(Guaranteed for V
DD
= +3.0 V to +5.0 V
±
10%)
Min
Max
0
Units
Degrees
ns
Interchannel Phase Deviation
Input Clock Jitter Rejection
10
DIGIT AL I/O
(Guaranteed for V
DD
= +3.0 V to +5.0 V
±
10%)
Min
Max
Units
V
IH
V
IL
I
IH
@ V
IH
= +5.0 V
I
IL
@ V
IL
= 0 V
V
OH
@ I
OH
= –4 mA
V
OL
@ I
OL
= 4 mA
Input Capacitance
2.0
V
V
μ
A
μ
A
V
V
pF
0.8
4
4
2.4
0.4
15
DIGIT AL T IMING
(Guaranteed over 0
°
C to +70
°
C, V
DD
= +3.0 V to +5.0 V
±
10%)
Min
Max
Units
t
RPWL
t
DBP
F
BCLK
t
DBL
t
DBH
t
DLS
t
DDS
t
DDH
t
SFPW
t
SFSU
t
CSPW
t
CSSU
t
LRSU
RESET LO Pulse Width
BCLK Period
BCLK Frequency (1/t
DBP
)
BCLK LO Pulse Width
BCLK HI Pulse Width
LRCLK Setup to BCLK
SDAT A Setup to BCLK
SDAT A Hold from BCLK
SFCLK HI Pulse Width
VBIT , UBIT , CSBIT , PARIT Y, ERROR Setup to SFCLK
CSCLK HI Pulse Width
CA, CB, CC, CD, CE, CON/
PRO
Setup to CSCLK
CSLR Setup to CSCLK
100
100
ns
ns
MHz
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
10
40
40
10
90
15
100
40
100
40
20
POWE R
Min
T yp
Max
Units
Supplies
Voltage, DV
DD
Operational Current, I
DD
(DV
DD
= +5.0 V)
Operational Current, I
DD
(DV
DD
= +3.0 V)
Power-Down Current, I
DD
(DV
DD
= +5.0 V)
Power-Down Current, I
DD
(DV
DD
= +3.0 V)
2.7
5.5
T BD
T BD
T BD
T BD
V
mA
mA
mA
mA
T BD
T BD
T BD
T BD
Dissipation
Operational (DV
DD
= +5.0 V)
Operational (DV
DD
= +3.0 V)
Power-Down (DV
DD
= +5.0 V)
Power-Down (DV
DD
= +3.0 V)
T BD
T BD
T BD
T BD
T BD
T BD
T BD
T BD
mW
mW
mW
mW
REV. 0
–2–
AD1895–SPECIFICATIONS
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AD1895YRS 制造商:Rochester Electronics LLC 功能描述:192KHZ 8:1 STEREO ASYNC S - Bulk
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