參數(shù)資料
型號： 9S12XDP512DGV2
英文描述： Device User Guide for Mask Set L15Y - (Second Silicon - Enhanced Feature Set)
中文描述： 設(shè)備用戶指南掩模組L15Y - （二硅-增強(qiáng)的功能集）
文件頁數(shù)： 87/152頁
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代理商： 9S12XDP512DGV2
87
Section 3 System Clock Description
3.1 Overview
The Clock and Reset Generator module (CRG) provides the internal clock signals for the core and all
peripheral modules.
Figure 3-1
shows the clock connections from the CRG to all modules.
Consult the CRG Block User Guide for details on clock generation.
Figure 3-1 Clock Connections
SCI0 . . SCI 5
SPI0 . . SPI2
IIC0 & IIC1
ATD0 & ATD1
CAN0 . . CAN4
CRG
bus clock
EXTAL
XTAL
core clock
oscillator clock
RAM
S12X
XGATE
EEPROM
FLASH
PIT
ECT
PIM
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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