VERSACLOCK LOW POWER CLOCK GENERATOR EEPROM CLOCK GENERATOR
參數(shù)資料
型號(hào)： 5P49EE801NDGI
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 23/27頁(yè)
文件大小： 0K
描述： IC CLOCK GENERATOR 28QFN
標(biāo)準(zhǔn)包裝： 75
系列： VersaClock™
類型： 時(shí)鐘發(fā)生器
PLL： 帶旁路
輸入： LVTTL，晶體
輸出： LVCMOS，LVDS，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:7
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 150MHz
除法器/乘法器： 是/無(wú)
電源電壓： 1.71 V ~ 1.89 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 28-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 28-VFQFPN（4x4）
包裝： 管件
其它名稱： 800-2524
IDT5P49EE801
VERSACLOCK LOW POWER CLOCK GENERATOR
EEPROM CLOCK GENERATOR
IDT VERSACLOCK LOW POWER CLOCK GENERATOR
5
IDT5P49EE801
REV M 072512
Ideal Power Up Sequence
Ideal Power Down Sequence
V
t
VDD, VDDx
VDDO1
VDDO2, VDDO3
1) VDD and VDDx must come up first, followed by VDDO
2) VDDO1 must come up within 1ms after VDD and VDDX come up
3) VDDO2/3 must be equal to, or lower than, VDDO1
4) VDD and VDDx have approx. the same ramp rate
5) VDDO1 and VDDO2/3 have approx. same ramp rate
1 ms
V
t
VDD, VDDx
VDDO1
1) VDDO must drop first, followed by VDD and VDDx
2) VDD and VDDx must come down within 1ms after VDDO1 comes down
3) VDDO2/3 must be equal to, or lower than, VDDO1
4) VDD and VDDx have approx. the same ramp rate
5) VDDO1 and VDDO2/3 have approx. same ramp rate
VDDO2, VDDO3
1 ms
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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